[发明专利]多调节器电路和包括多调节器电路的集成电路有效
| 申请号: | 201210365705.4 | 申请日: | 2012-09-27 |
| 公开(公告)号: | CN103092244A | 公开(公告)日: | 2013-05-08 |
| 发明(设计)人: | 俞弼善 | 申请(专利权)人: | 爱思开海力士有限公司 |
| 主分类号: | G05F1/56 | 分类号: | G05F1/56 |
| 代理公司: | 北京弘权知识产权代理事务所(普通合伙) 11363 | 代理人: | 周晓雨;俞波 |
| 地址: | 韩国*** | 国省代码: | 韩国;KR |
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| 摘要: | |||
| 搜索关键词: | 调节器 电路 包括 集成电路 | ||
1.一种多调节器电路,包括:
调节器,所述调节器被配置成调节输入电压以产生恒定电压;以及
多个分压电路,所述多个分压电路被配置成分别输出通过基于多个电压发生码对所述恒定电压进行分压所获得的分压电压。
2.如权利要求1所述的多调节器电路,其中,所述调节器包括比较器,所述比较器被配置成将从所述调节器的输出电压分压获得的反馈电压与参考电压进行比较并根据比较结果输出控制信号,所述调节器的输出电压响应于所述控制信号而被提供至所述多个分压电路。
3.如权利要求1所述的多调节器电路,其中,所述多个分压电路中的每个包括:
多个电阻器,所述多个电阻器串联耦接在所述调节器的输出端子与接地节点之间;
至少一个高电压开关,所述至少一个高电压开关被相对应的电压发生码中所包括的至少一个数字比特使能,且被配置成与所述电阻器的节点中的至少一个和输出节点耦接;以及
至少一个晶体管,所述至少一个晶体管被所述相对应的电压发生码中的不包括被输入至所述高电压开关的所述至少一个数字比特的一个或更多个数字比特导通,并且耦接在所述接地节点与所述电阻器的节点之中的未耦接到所述高电压开关的至少一个节点之间。
4.如权利要求3所述的多调节器电路,其中:
输入至所述多个分压电路中的每个的所述多个电压发生码中的每个包括多个数字比特,并且
所述多个电压发生码互不相同。
5.如权利要求1所述的多调节器电路,其中,所述多个分压电路中的每个配置成根据通过相对应的电压发生码所确定的内部电阻值而对所述恒定电压分压。
6.如权利要求1所述的多调节器电路,其中,所述多个分压电路与所述调节器的输出端子耦接,并且经由所述输出端子共同地接收所述恒定电压。
7.一种集成电路,包括:
控制器,所述控制器被配置成输出多个电压发生码和用于控制内部电路的操作的控制信号;
电压发生器,所述电压发生器被配置成响应于从所述控制器产生的使能信号来产生高电压和参考电压;
调节器,所述调节器被配置成利用所述高电压和所述参考电压来输出具有恒定电压电平的调节电压;以及
多个分压电路,所述多个分压电路被配置成分别输出通过基于所述多个电压发生码而对所述调节电压进行分压所获得的分压电压。
8.如权利要求7所述的集成电路,其中,所述调节器包括比较器,所述比较器被配置成将从所述调节器的输出电压分压获得的反馈电压与参考电压进行比较并根据比较结果输出控制信号,所述调节器的输出电压响应于所述控制信号而被提供至所述多个分压电路。
9.如权利要求7所述的集成电路,其中,所述多个分压电路中的每个包括:
多个电阻器,所述多个电阻器串联耦接在所述调节器的输出端子与接地节点之间;
至少一个高电压开关,所述至少一个高电压开关被相对应的电压发生码中所包括的至少一个数字比特使能,并且被配置成与所述电阻器的节点中的至少一个和输出节点耦接;以及
至少一个晶体管,所述至少一个晶体管被所述相对应的电压发生码中的不包括被输入至所述高电压开关的所述至少一个数字比特的一个或更多个数字比特导通,并且耦接在所述接地节点与所述电阻器的节点之中的未耦接到所述高电压开关的至少一个节点之间。
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