[发明专利]时钟信号转换方法和装置有效

专利信息
申请号: 201210149979.X 申请日: 2012-05-15
公开(公告)号: CN103427825B 公开(公告)日: 2017-03-15
发明(设计)人: 廖健生 申请(专利权)人: 深圳市中兴微电子技术有限公司
主分类号: H03K19/0185 分类号: H03K19/0185
代理公司: 北京安信方达知识产权代理有限公司11262 代理人: 龙洪
地址: 518083 广*** 国省代码: 广东;44
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摘要:
搜索关键词: 时钟 信号 转换 方法 装置
【权利要求书】:

1.一种时钟信号转换方法,其特征在于,包括以下步骤:

电平移动电路收到电流模逻辑CML差分信号时,对其进行电平移动,并将经过电平移动的CML差分信号输入电平转换电路;

所述电平转换电路根据收到的CML差分信号,产生多相正交时钟信号。

2.根据权利要求1所述的方法,其特征在于:所述电平转换电路根据收到的CML差分信号,产生多相正交时钟信号步骤包括:

所述电平转换电路接收经过电平移动的CML差分信号,将其放大,然后输出相位相差180度的第一互补金属氧化物半导体CMOS时钟信号和第二CMOS时钟信号;

所述第一占空比调整电路接收所述第一CMOS时钟信号,产生相位分别为0度和180度的时钟信号;

所述第二占空比调整电路接收所述第二CMOS时钟信号,产生相位分别为90度和270度的时钟信号。

3.根据权利要求2所述的方法,其特征在于:所述电平移动电路中包括两个由N型金属氧化物半导体NMOS管和电流源串接而成的电平移动模块;

所述电平转换电路中包括交叉耦合的第一P型金属氧化物半导体PMOS管和第二PMOS管,还包括接收输入信号的第一NMOS管和第二NMOS管;

所述第一占空比调整电路由第一二分频器、第一反相器、第一驱动反相器、第二二分频器、第二反相器及第二驱动反相器顺序串接而成;

所述第二占空比调整电路由第三二分频器、第三反相器、第三驱动反相器、第四二分频器、第四反相器及第四驱动反相器顺序串接而成。

4.根据权利要求3所述的方法,其特征在于:所述电平移动电路收到CML差分信号时,对其进行电平移动,并将经过电平移动的CML差分信号输入电平转换电路步骤包括:

所述电平移动电路通过第一电平移动模块对收到的原始CML差分信号中的第一CML信号进行电平移动,通过第二电平移动模块对所述原始CML差分信号中的第二CML信号进行电平移动,使所述第一CML信号和第二CML信号的电平达到所述电平转换电路的最佳工作电平;

然后所述第一电平移动模块和第二电平移动模块将各自处理的经过电平移动的信号输入所述电平转换电路。

5.根据权利要求4所述的方法,其特征在于,所述电平转换电路接收经过电平移动的CML差分信号,将其放大,然后输出相位相差180度的第一CMOS时钟信号和第二CMOS时钟信号步骤包括:

所述电平转换电路通过所述第一NMOS管接收经过电平移动的第一CML信号,并将其输入所述第一PMOS管中;通过所述第二NMOS管接收经过电平移动的第二CML信号,并将其输入所述第二PMOS管中;

所述第一PMOS管对收到的信号进行放大,然后输出所述第一CMOS时钟信号;

所述第二PMOS管对收到的信号进行放大,然后输出所述第二CMOS时钟信号。

6.根据权利要求5所述的方法,其特征在于,所述第一占空比调整电路接收所述第一CMOS时钟信号,产生相位分别为0度和180度的时钟信号步骤包括:

所述第一二分频器接收所述第一CMOS时钟信号,产生第一驱动信号CK2,并将所述第一驱动信号CK2输入所述第一反相器中;

所述第一反相器收到所述第一驱动信号CK2后,产生相位为0度的时钟信号CK3,并将所述时钟信号CK3输入所述第一驱动反相器中;

所述第一驱动反相器收到所述时钟信号CK3后,产生第二驱动信号CK4,并将所述第二驱动信号CK4输入所述第二二分频器中;

所述第二二分频器收到所述第二驱动信号CK4后,根据所述电平转换电路输入的第一CMOS时钟信号产生第三驱动信号CK5,并将所述第三驱动信号CK5输入所述第二反相器中;

所述第二反相器收到所述第三驱动信号CK5后,产生相位为180度的时钟信号CK6。

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