[发明专利]齐纳二极管的制造方法有效
申请号: | 201210046164.9 | 申请日: | 2012-02-27 |
公开(公告)号: | CN102592995A | 公开(公告)日: | 2012-07-18 |
发明(设计)人: | 梁博 | 申请(专利权)人: | 上海先进半导体制造股份有限公司 |
主分类号: | H01L21/329 | 分类号: | H01L21/329 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 郑玮 |
地址: | 200233 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 齐纳二极管 制造 方法 | ||
1.一种齐纳二极管的制造方法,包括:
提供衬底,所述衬底包括正面以及与正面相对的背面,所述衬底的正面上形成有外延层;
刻蚀所述外延层和部分厚度的衬底形成第一深槽,所述第一深槽为环形;
在所述外延层上形成绝缘层,同时填充所述第一深槽形成第一深槽填充;
刻蚀所述外延层和部分厚度的衬底,在所述第一深槽填充包围的区域内形成至少一个第二深槽;
在所述图形化的绝缘层上形成原位掺杂多晶硅,同时填充所述第二深槽形成第二深槽填充;
对所述衬底进行退火工艺形成扩散区域,所述扩散区域和衬底构成齐纳二极管的PN结;
刻蚀所述原位掺杂多晶硅层形成图形化的多晶硅,所述图形化的多晶硅作为齐纳二极管的阴极;
在所述衬底的背面形成金属层,所述金属层作为齐纳二极管的阳极。
2.如权利要求1所述的方法,其特征在于,刻蚀所述原位掺杂多晶硅层形成图形化的多晶硅之后,还包括:对所述衬底进行减薄。
3.如权利要求1所述的方法,其特征在于,所述外延层的厚度范围为17μm~22μm。
4.如权利要求1所述的方法,其特征在于,所述衬底的电阻率范围为0.010Ω·cm~0.020Ω·cm。
5.如权利要求1所述的方法,其特征在于,在刻蚀所述外延层和部分厚度的衬底形成第一深槽之前,还包括:
在所述衬底上形成掩膜层;以及
刻蚀所述掩膜层形成图性化的掩膜层。
6.如权利要求5所述的方法,其特征在于,所述掩膜层为二氧化硅。
7.如权利要求5所述的方法,其特征在于,利用淀积的方法在所述衬底上形成掩膜层。
8.如权利要求5所述的方法,其特征在于,所述掩膜层的厚度范围为1.5μm~2.5um。
9.如权利要求1所述的方法,其特征在于,所述第一深槽的深度范围为25μm~30μm,第一深槽的槽宽为1.0μm~1.4μm。
10.如权利要求1所述的方法,其特征在于,在刻蚀所述外延层和部分厚度的衬底形成第二深槽之前,还包括:刻蚀所述绝缘层形成图形化的绝缘层。
11.如权利要求1所述的方法,其征在于,所述第二深槽的深度范围为20μm~30μm,第二深槽的槽宽为1.0μm~1.4μm,相邻的第二深槽之间的间距为1.0μm~1.4μm。
12.如权利要求1所述的方法,其特征在于,所述退火的温度范围为1100℃~1150℃,退火时间为50min~100min。
13.如权利要求1所述的方法,其特征在于,利用化学气相淀积工艺在所述图形化的绝缘层上形成原位掺杂多晶硅。
14.如权利要求13所述的方法,其特征在于,所述化学气相淀积工艺的温度范围590℃~630℃,压力范围250毫托~300毫托,反应气体为硅烷和磷烷,所述硅烷和磷烷的流量比范围为9∶1~10∶1。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
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H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造