[发明专利]半导体器件及制造半导体器件的方法有效
| 申请号: | 201110387820.7 | 申请日: | 2011-11-29 |
| 公开(公告)号: | CN102623489A | 公开(公告)日: | 2012-08-01 |
| 发明(设计)人: | 浅野正义;三谷纯一 | 申请(专利权)人: | 富士通半导体股份有限公司 |
| 主分类号: | H01L29/423 | 分类号: | H01L29/423;H01L27/02;H01L21/28;H01L21/8234 |
| 代理公司: | 北京三友知识产权代理有限公司 11127 | 代理人: | 李辉;黄纶伟 |
| 地址: | 日本神*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 半导体器件 制造 方法 | ||
1.一种半导体器件,包括:
横向扩散金属氧化物半导体晶体管;以及
静电放电保护元件,其中,
所述横向扩散金属氧化物半导体晶体管包括:
第一栅电极,其形成在半导体基底上,绝缘膜介于所述半导体基底和所述第一栅电极之间;
第一主体区域,其通过将第一导电类型的杂质注入到所述半导体基底中而形成,并且布置在所述第一栅电极的一个边缘侧;
第二导电类型的第一源极区域,其布置在所述第一主体区域的上部中;
第一元件隔离膜,其形成在所述半导体基底的上部中,并且被布置成与所述第一栅电极重叠;
第一漏极区域,其形成在所述半导体基底内部,包括所述第二导电类型的杂质,并且被布置在与所述第一元件隔离膜的边缘部分接触并与所述第一栅电极分开的位置;以及
第一漂移区域,其形成在所述半导体基底内部,包括所述第二导电类型的杂质,并且与所述第一主体区域和所述第一漏极区域接触,并且所述静电放电保护元件包括:
第二栅电极,其形成在所述半导体基底上,绝缘膜介于所述半导体基底和所述第二栅电极之间;
第二主体区域,其形成在所述半导体基底内部,包括所述第一导电类型的杂质,并且被布置在所述第二栅电极的一个边缘侧;
所述第二导电类型的第二源极区域,其布置在所述主体区域的上部中;
第二元件隔离膜,其形成在所述半导体基底的上部中,并且被布置成与所述第二栅电极重叠;
阳极区域,其形成在所述半导体基底内部,包括所述第一导电类型的杂质,并且被布置在与所述第二元件隔离膜的边缘部分接触并与所述第二栅电极分开的位置;
第三元件隔离膜,其形成在所述半导体基底的上部中,并且被布置为邻近所述阳极区域;
第二漏极区域,其形成在所述半导体基底内部,包括所述第二导电类型的杂质,并且与所述第三元件隔离膜接触;以及
第二漂移区域,其形成在所述半导体基底内部,包括所述第二导电类型的杂质,并且与所述第二主体区域、所述阳极区域和所述第二漏极区域接触,其中
所述半导体器件具有A1≥A2并且B1<B2的关系,其中,A1表示所述第一栅电极和所述第一元件隔离膜的重叠长度;A2表示所述第二栅电极和所述第二元件隔离膜的重叠长度;B1表示所述第一栅电极和所述第一漏极区域之间的距离;并且B2表示所述第二栅电极与所述阳极区域之间的距离。
2.根据权利要求1所述的半导体器件,其中,
所述第一元件隔离膜、所述第二元件隔离膜和所述第三元件隔离膜是通过使用浅沟隔离方法形成的氧化物膜。
3.根据权利要求1或2所述的半导体器件,其中,
所述第一主体区域被所述第一漂移区域包围,并且
所述第二主体区域被所述第二漂移区域包围。
4.根据权利要求1或2所述的半导体器件,其中,
所述第一主体区域和所述第一漂移区域在垂直方向上彼此不重叠,并且
所述第二主体区域和所述第二漂移区域在所述垂直方向上彼此不重叠。
5.根据权利要求1或2所述的半导体器件,其中,
所述第一漂移区域被所述第一主体区域包围,并且
所述第二漂移区域被所述第二主体区域包围。
6.根据权利要求1或2所述的半导体器件,其中,
所述第一栅电极和所述第二栅电极都形成为环形。
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