[发明专利]自适应感应设计有效
申请号: | 201110338666.4 | 申请日: | 2011-10-31 |
公开(公告)号: | CN102664609A | 公开(公告)日: | 2012-09-12 |
发明(设计)人: | 刘逸群 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H03K5/13 | 分类号: | H03K5/13 |
代理公司: | 北京德恒律师事务所 11306 | 代理人: | 陆鑫;高雪琴 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 自适应 感应 设计 | ||
1.一种方法,包括:
接收具有时钟脉冲宽度持续时间的时钟信号;
接收延迟时间;
确定所述时钟脉冲宽度持续时间和所述延迟时间之间的第一关系和第二关系;以及
生成新时钟,所述新时钟具有由所述第一关系和所述延迟时间确定的第一新时钟脉冲宽度持续时间以及由所述第二关系和所述时钟脉冲宽度持续时间确定的第二新时钟脉冲宽度持续时间;
其中
基于所述第一关系和所述第二关系,所述第一新时钟脉冲宽度持续时间和所述第二新时钟脉冲宽度持续时间之间的切换是自动的。
2.根据权利要求1所述的方法,其中:
当所述时钟脉冲宽度持续时间大于所述延迟时间时,所述第一新时钟脉冲宽度持续时间与所述延迟时间相同;以及
当所述时钟脉冲宽度持续时间小于所述延迟时间时,所述第二新时钟脉冲宽度延迟时间与所述第一时钟持续时间相同,
其中,生成所述新时钟包括:
在所述延迟时间之后使所述时钟反相,以形成被延迟的反相时钟;以及
执行所述时钟和被延迟的反相时钟之间的逻辑AND,
所述方法进一步包括:
生成具有所述新时钟脉冲宽度的图像的字线,用于存储器阵列中。
3.根据权利要求1所述的方法,进一步包括:通过以下步骤生成感应放大器控制信号:
使所述新时钟反相,以形成反相新时钟;
在第二延迟时间之后使所述反相新时钟反相,以形成被延迟反相的反相新时钟;以及
执行所述反相新时钟和所述被延迟反相的反相新时钟之间的逻辑AND函数,
其中,选择所述第二延迟时间,使得感应放大器具有足够的时间将差分信号放大为全摆幅信号。
4.根据权利要求1所述的方法,进一步包括:生成位线预充电信号,其为所述新时钟的图像,
其中,所述方法进一步包括通过以下步骤生成感应放大器复位信号:
生成位线预充电信号,其具有所述新时钟的图像;
生成感应放大器控制信号;以及
执行所述位线预充电信号和所述感应放大器控制信号之间的逻辑OR函数;
其中,生成所述感应放大器控制信号包括
使所述新时钟反相,以形成反相新时钟;
在第二延迟时间之后使所述反相新时钟反相,以形成被延迟反相的反相新时钟;以及
执行所述反相新时钟和所述被延迟反相的反相新时钟之间的逻辑AND函数,
其中,所述方法进一步包括:选择所述延迟时间,以满足指定位线分裂的要求。
5.一种电路,包括:
时钟生成电路,被配置成接收时钟延迟时间和具有时钟脉冲宽度的时钟,并且生成新时钟,所述新时钟具有基于所述时钟脉冲宽度和所述延迟时间之间的第一关系和第二关系的新时钟脉冲宽度;所述新时钟脉冲宽度具有基于所述延迟时间和所述第一关系的第一脉冲宽度以及基于所述时钟脉冲宽度和所述第二关系的第二脉冲宽度;
字线生成电路,被配置成接收所述新时钟并且生成具有所述新时钟的图像的字线;以及
感应放大器控制信号生成电路,被配置成接收所述新时钟和信号延迟时间,以生成用于控制感应放大器的感应放大器控制信号。
6.根据权利要求5所述的电路,其中,所述感应放大器控制信号具有持续时间为所述信号延迟时间的脉冲宽度,
其中,所述时钟生成电路包括:
延迟反相电路,被配置成在所述延迟时间之后使所述时钟反相,以生成第二时钟;以及
AND门,被配置成接收所述时钟和所述第二时钟,以生成所述新时钟,
其中,所述感应放大器控制信号生成电路包括:
反相电路,被配置成接收所述新时钟的反相和所述信号延迟时间,以基于所述新时钟的所述反相和所述信号延迟时间生成第二时钟;以及
AND门,被配置成接收所述第二时钟和所述新时钟的反相,以形成所述感应放大器控制信号,
所述电路进一步包括:信号生成电路,被配置成接收所述新时钟并且生成具有所述新时钟的图像的位线预充电信号。
7.根据权利要求5所述的电路,进一步包括:信号生成电路,被配置成接收所述新时钟并且生成感应放大器复位信号,所述感应放大器复位信号具有由所述感应放大器控制信号和具有所述新时钟的图像的位线预充电信号的OR操作得到的复位脉冲宽度,其中,所述时钟延迟时间足以使位线分裂加强到指定值。
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