[发明专利]基于埋层N型阱的异质结1T-DRAM结构及其制备方法有效
| 申请号: | 201110314331.9 | 申请日: | 2011-10-17 |
| 公开(公告)号: | CN102637687A | 公开(公告)日: | 2012-08-15 |
| 发明(设计)人: | 黄晓橹;顾经纶;陈玉文 | 申请(专利权)人: | 上海华力微电子有限公司 |
| 主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L29/06;H01L21/8242 |
| 代理公司: | 上海新天专利代理有限公司 31213 | 代理人: | 王敏杰 |
| 地址: | 201210 上海市浦*** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 基于 异质结 dram 结构 及其 制备 方法 | ||
1.一种基于埋层N型阱的异质结1T-DRAM结构,其特征在于,
包括硅基底层、体区层、以及位于所述体区层和硅基底层之间的埋层N型阱,所述体区层材质为P型锗硅,所述埋层N型阱材质为N型碳化硅;
在所述体区层上表面还覆盖有一层硅膜;
所述异质结1T-DRAM结构还包括位于体区层上的栅极和位于栅极两侧的漏、源区;
以所述栅极为中心,所述漏、源区外侧分别设有浅沟槽;所述浅沟槽下底低于埋层N型阱上表面、而高于埋层N型阱下表面。
2.根据权利要求1所述的异质结1T-DRAM结构,其特征在于,所述漏、源区材质为N+型碳化硅。
3.根据权利要求1或2所述的异质结1T-DRAM结构,其特征在于,所述碳化硅中碳的摩尔含量为0.01%~10%。
4.根据权利要求1或3所述的异质结1T-DRAM结构,其特征在于,所述埋层N型阱厚度≥10nm。
5.根据权利要求1所述的异质结1T-DRAM结构,其特征在于,所述体区层锗的摩尔含量为0.1%~100%。
6.根据权利要求1所述的异质结1T-DRAM结构,其特征在于,所述漏、源区下方体区层厚度为所述体区层最大厚度的1/5~4/5。
7.根据权利要求1、5或6所述的异质结1T-DRAM结构,其特征在于,所述体区层厚度≥30nm。
8.一种制备如权利要求1所述异质结1T-DRAM结构的方法,其特征在于,步骤包括:
步骤1,硅基底上外延一层N型碳化硅层;
步骤2,在所述N型碳化硅层上外延一层P型锗硅层;在P型锗硅层上再外延一层硅膜;
步骤3,形成浅沟槽,使所述浅沟槽位于P型锗硅层上外延硅膜、P型锗硅层和N型碳化硅中,并且下底面位于N型碳化硅中;
步骤4,在相邻两个沟槽间制备栅极,刻蚀栅极与两侧浅沟槽之间的P型锗硅层,但不刻蚀至N型碳化硅层,分别形成漏区槽、源区槽,分别对漏区槽、源区槽进行填充形成漏、源区。
9.根据权利要求9所述的方法,其特征在于,步骤4中刻蚀掉的P型锗硅厚度为P型锗硅厚度的1/5~4/5。
10.根据权利要求9所述的方法,其特征在于,对漏区槽、源区槽进行填充的材料为N+型碳化硅。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的





