[发明专利]阵列基板及其制作方法无效
申请号: | 201110288858.9 | 申请日: | 2011-09-26 |
公开(公告)号: | CN102629576A | 公开(公告)日: | 2012-08-08 |
发明(设计)人: | 宁策 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | H01L21/77 | 分类号: | H01L21/77;H01L27/02;H01L29/786 |
代理公司: | 北京路浩知识产权代理有限公司 11002 | 代理人: | 韩国胜;王莹 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 阵列 及其 制作方法 | ||
1.阵列基板的制作方法,其特征在于,包括以下步骤:
步骤S1、在基板上连续沉积栅电极,绝缘层和有源层,并通过第一次掩模工艺形成栅电极、栅线和有源层图形;
步骤S2、在完成步骤S1的所述基板上沉积保护层,并通过第二次掩模工艺在所述保护层上形成过孔;
步骤S3、在完成步骤S2的所述基板上沉积像素电极和源漏电极,并通过第三次掩模工艺形成像素区域、源漏电极和数据线。
2.如权利要求1所述的阵列基板的制作方法,其特征在于,所述步骤S1具体包括:
在基板上沉积金属层作为栅电极,在所述金属层上沉积SiNx或SiOx作为绝缘层,在所述绝缘层上沉积a-Si作为有源层;然后采用干法刻蚀对所述有源层及绝缘层进行刻蚀,再采用湿法刻蚀对栅电极进行刻蚀,得到栅电极和栅线图形;最后采用干法刻蚀形成有源层图形。
3.如权利要求2所述的阵列基板的制作方法,其特征在于,所述步骤S2具体包括:
在完成步骤S1的所述基板上沉积SiNx或SiOx作为保护层,利用第二次掩模工艺在所述有源层上形成过孔,在暴露的所述有源层上形成掺杂n型非晶硅的接触层。
4.如权利要求3所述的阵列基板的制作方法,其特征在于,所述步骤S3具体包括:
在完成步骤S2的所述基板上沉积ITO作为像素电极,在所述像素电极上沉积金属层作为源漏电极,采用湿法刻蚀将数据线、源漏电极和像素电极以外的金属层和ITO去除,然后采用干法刻蚀去除掉像素区域的光刻胶,采用湿法刻蚀形成源漏电极和数据线。
5.如权利要求1所述的阵列基板的制作方法,其特征在于,所述步骤S1具体包括:
在基板上沉积金属层作为栅电极,在所述金属层上沉积SiNx或SiOx作为绝缘层,在所述绝缘层上沉积金属氧化物作为有源层;然后采用湿法刻蚀对所述有源层进行刻蚀,采用干法刻蚀对所述绝缘层进行刻蚀,再采用湿法刻蚀对栅电极进行刻蚀,得到栅电极和栅线图形;最后采用湿法刻蚀形成有源层图形。
6.如权利要求5所述的阵列基板的制作方法,其特征在于,所述金属氧化物包括:氧化锌、氧化铟锌镓及其混合物。
7.如权利要求5所述的阵列基板的制作方法,其特征在于,所述步骤S2具体包括:
在完成步骤S1的所述基板上沉积SiNx或SiOx作为保护层,利用第二次掩模工艺在所述有源层上形成过孔。
8.如权利要求5所述的阵列基板的制作方法,其特征在于,所述步骤S3具体包括:
在完成步骤S2的所述基板上沉积ITO作为像素电极,在所述像素电极上沉积金属层作为源漏电极,采用湿法刻蚀将数据线、源漏电极和像素电极以外的金属层和ITO去除,然后对像素区域的光刻胶进行灰化,再利用湿法刻蚀形成源漏电极和数据线。
9.如权利要求3-4、6-8任一项所述的阵列基板的制作方法,其特征在于,所述绝缘层的厚度为200nm-400nm,所述保护层的厚度为250nm-400nm。
10.如权利要求1-9任一项所述的方法制作的阵列基板,其特征在于,包括:
基板,形成于所述基板上的栅电极,形成于所述栅电极上的绝缘层,形成于所述绝缘层上的有源层,形成于所述基板上的保护层,形成于所述保护层和有源层上的像素电极,以及形成于所述像素电极上的源漏电极。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造