[发明专利]高速访问存储器和方法有效
申请号: | 201080055681.1 | 申请日: | 2010-11-16 |
公开(公告)号: | CN102652311A | 公开(公告)日: | 2012-08-29 |
发明(设计)人: | 张家宝;M.J.H.李;S.沃德 | 申请(专利权)人: | 国际商业机器公司 |
主分类号: | G06F12/08 | 分类号: | G06F12/08;G11C7/10;G11C7/24;G11C8/10;G11C8/20;G11C15/04 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 周少杰 |
地址: | 美国纽*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 高速 访问 存储器 方法 | ||
技术领域
本申请通常涉及高速缓存存储器、用于门控这样的存储器的行的读取访问的方法以及设计结构。
背景技术
随机访问存储器(RAM)最通常指暂时存储动态数据以增加计算机性能的计算机芯片。通过在随机访问存储器中存储经常使用或激活的文件,计算机可以比计算机从大的多的硬盘驱动器检索数据的情况更快地访问数据。随机访问存储器是易失性存储器,意味着一旦电源关断,它将损失其内容。这对于诸如硬盘和闪存的非易失性存储器是不同的,该非易失性存储器不要求电源来保持数据。当计算机正常关闭时,位于随机访问存储器中的数据提交给硬盘驱动器或闪存驱动器上的永久存储。在下一次引导时,RAM开始填充在启动时自动加载的程序以及用户打开的文件。
还称为高速缓存存储器阵列的随机访问存储器包括多个存储器单元,其具有与每个存储器单元相关联的单独的逻辑电路。高速缓存存储器阵列也可以采用有效位的构思。存储器单元的每个逻辑行包含用于指示存储的数据有效或无效的至少一位。传统上,将出现查找表而不管有效位的状态。如果为有效位存储的值表示无效数据,则存储器阵列输出后的额外逻辑将丢弃从读取操作返回的数据。用于在无效位中存储数据的存储器单元可能不同于传统的单元,如6T单元。该差异包括重置端口,其可以切换单元的状态而不需要标准字线驱动器使能访问。
发明内容
在一个说明性实施例中,提供了一种高速缓存访问存储器中的方法,用于门控已经无效的高速缓存访问存储器中的任何行的读取访问。所述说明性实施例通过高速缓存访问存储器中的地址解码器,发送存储器访问到与所述存储器访问相关联的非门控字线驱动器和门控字线驱动器。所述说明性实施例通过非门控字线驱动器,确定所述存储器访问是写入访问或读取访问。响应于非门控字线驱动器确定所述存储器访问是读取访问,所述说明性实施例通过非门控字线驱动器,输出有效位存储器单元中存储的数据到门控字线驱动器。所述说明性实施例通过门控字线驱动器,确定所述存储器访问是写入访问或读取访问。响应于门控字线驱动器确定所述存储器访问是读取访问,所述说明性实施例通过门控字线驱动器,确定通过非门控字线驱动器来自有效位存储器单元的数据是有效数据或无效数据。响应于数据无效,所述说明性实施例通过门控字线驱动器,拒绝与门控字线驱动器相关联的存储器单元的行中的数据的输出。
在另一说明性实施例中,提供了一种高速缓存访问存储器。所述高速缓存访问存储器可以包括:高速缓存访问存储器中的地址解码器,发送存储器访问到与所述存储器访问相关联的非门控字线驱动器和门控字线驱动器。非门控字线驱动器确定所述存储器访问是写入访问或读取访问,并且响应于非门控字线驱动器确定所述存储器访问是读取访问,输出有效位存储器单元中存储的数据到门控字线驱动器。门控字线驱动器确定所述存储器访问是写入访问或读取访问,响应于门控字线驱动器确定所述存储器访问是读取访问,确定通过非门控字线驱动器来自有效位存储器单元的数据是有效数据或无效数据,以及响应于数据无效,拒绝与门控字线驱动器相关联的存储器单元的行中的数据的输出。
在另一说明性实施例中,提供了一种体现机器可读介质中的设计结构电路,用于设计、制造或测试集成电路。所述设计结构可以编码在机器可读数据存储介质上,并且可以包括当在计算机辅助设计系统中处理时生成布斯(booth)解码器的机器可执行表示的元件。所述设计结构可以是硬件描述语言(HDL)设计结构。所述设计结构可以包括网表,并且可以驻留在存储介质上作为用于集成电路的版图数据的交换的数据。
结合本发明的这些和其他特征和优点将在下面的本发明的示例实施例的详细描述中描述,或者将通过下面的本发明的示例实施例的详细描述对本领域普通技术人员变得明显。
附图说明
当结合附图阅读时,通过参考参考说明性实施例的以下详细描述,本发明及其优选使用模式和进一步的目的和优点将被最好地理解,附图中:
图1是根据说明性实施例的处理器的示例性方块图;
图2图示根据示例性实施例的、包括多个存储器单元的典型的高速缓存存储器阵列的高级示例;
图3描绘根据说明性实施例的典型存储器单元的示例;
图4图示根据说明性实施例的、包括多个存储器单元和有效位存储器单元的高速缓存存储器阵列的一个示例;
图5描绘根据说明性实施例的非门控字线驱动器的一个示例性实现;
图6描述根据说明性实施例的门控字线驱动器的一个示例性实现;
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