[实用新型]一种基于虚拟接口的条码解码芯片及条码解码装置有效

专利信息
申请号: 201020213133.4 申请日: 2010-06-01
公开(公告)号: CN201725349U 公开(公告)日: 2011-01-26
发明(设计)人: 蔡强;林建华;张义锦;陈永长 申请(专利权)人: 福建新大陆电脑股份有限公司
主分类号: G06K7/10 分类号: G06K7/10
代理公司: 深圳市威世博知识产权代理事务所(普通合伙) 44280 代理人: 何青瓦;李庆波
地址: 350015 福建省福*** 国省代码: 福建;35
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摘要:
搜索关键词: 一种 基于 虚拟 接口 条码 解码 芯片 装置
【权利要求书】:

1.一种基于虚拟接口的条码解码芯片,其特征在于,包括:

数据存储器,用于存储条码图像;

寄存器组,包括命令寄存器和数据寄存器,所述命令寄存器用于暂存命令,所述数据寄存器用于暂存数据;

条码解码流水线,用于处理所述条码图像;

主控逻辑模块,从所述命令寄存器获取处理命令,根据所述处理命令将所述数据存储器中存储的所述条码图像传输至所述条码解码流水线进行解码;

虚拟NAND闪存总线接口,与所述寄存器组电连接,用于传输符合NAND闪存接口标准的数据。

2.根据权利要求1所述的条码解码芯片,其特征在于,所述条码解码芯片进一步包括配置存储器,所述配置存储器与所述寄存器组电连接,用于存储所述条码解码流水线工作时的运算参数以及查表数据,所述条码解码流水线通过所述主控逻辑模块以及所述寄存器组从所述配置存储器获取所述运算参数以及所述查表数据。

3.根据权利要求1所述的条码解码芯片,其特征在于,所述条码解码芯片进一步包括配置存储器,所述配置存储器设置在所述条码解码流水线内部,用于存储所述条码解码流水线工作时的运算参数以及查表数据。

4.根据权利要求1所述的条码解码芯片,其特征在于,所述条码解码芯片包括由硬件逻辑实现的多个所述条码解码流水线,所述多个条码解码流水线对所述条码图像进行并行处理。

5.根据权利要求1所述的条码解码芯片,其特征在于,所述虚拟NAND闪存总线接口包括基本输入输出引脚、命令锁存使能引脚、地址锁存使能引脚、片选引脚、写使能引脚以及读使能引脚。

6.一种包括权利要求1-5任一项所述的条码解码芯片的条码解码装置,其 特征在于,包括:

USB接口,用于输入或输出符合USB通信协议的数据;

闪存数据控制模块,用于对所述虚拟NAND闪存总线接口进行访问及输入输出数据;

USB控制器,用于将从所述USB接口输入的所述符合USB通信协议的数据转换为存储数据输入所述闪存数据控制模块(117),以及将从所述闪存数据控制模块输出的数据转换为符合所述USB通信协议的数据,经由所述USB接口输出;

微处理器,用于协调所述闪存数据控制模块和所述USB控制器的工作状态。

7.一种包括权利要求1-5任一项所述的条码解码芯片的条码解码装置,其特征在于,包括:

存储卡接口,用于输入或输出符合存储卡通信协议的数据;

闪存数据控制模块,用于对所述虚拟NAND闪存总线接口进行访问及输入输出数据;

存储卡控制器,用于将从所述存储卡接口输入的符合存储卡通信协议的数据转换为存储数据输入所述闪存数据控制模块,以及将从所述闪存数据控制模块输出的数据转换为符合存储卡通信协议的数据,经由所述存储卡接口输出。

8.一种包括权利要求1-5任一项所述的条码解码芯片的条码解码装置,其特征在于,包括:

存储控制器,用于对所述虚拟NAND闪存总线接口进行访问及输入输出数据;

微处理器,通过所述存储控制器访问所述基于虚拟接口的条码解码芯片。

9.一种包括权利要求1-5任一项所述的条码解码芯片的条码解码装置,其特征在于,包括:

微处理器,与所述虚拟NAND闪存总线接口电连接,透过自带的指令集访问所述条码解码芯片。 

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