[发明专利]一种功能可重构的数字系统无效

专利信息
申请号: 201010169227.0 申请日: 2010-04-29
公开(公告)号: CN101847970A 公开(公告)日: 2010-09-29
发明(设计)人: 孟彬;任腾龙;易婷;洪志良;谢江滨 申请(专利权)人: 复旦大学
主分类号: H03F3/217 分类号: H03F3/217;H03M3/02
代理公司: 上海正旦专利代理有限公司 31200 代理人: 陆飞;盛志范
地址: 20043*** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 功能 可重构 数字 系统
【权利要求书】:

1.一种功能可重构的数字系统结构,其特征在于,它包括微控制器模块102、串行外设接口模块103、静态存储器组104、计数器106、定时器105和可配置逻辑阵列101;系统在运行时,通过编程指令控制微控制器102,从输出端口输出串行数据通过串行外设接口103配置静态存储器组104,不同的值对应着可配置逻辑阵列101不同的功能;可配置逻辑阵列101由可配置逻辑模块108与开关电路107组成,由开关电路107选择输入信号,通过查找表110对应的逻辑关系输出数据;可配置逻辑阵列101的输入信号由外部直接输入,或者由微控制器模块102输入;定时器105的开始控制信号和计时初值由可配置逻辑阵列101控制,计数器106的复位与置位信号也由可配置逻辑阵列101控制;计数器106与定时器105的计数频率以及可配置逻辑阵列101的时钟频率,由静态存储器组104控制。

2.根据权利要求1所述的功能可重构的数字系统,其特征在于:所述静态存储器组104分散在电路中,将每一个静态存储器布置在功能电路的旁边;该静态存储器的预充电管只在串行外设接口103的时序无效的时候预充电;可配置逻辑阵列101的开关电路107的控制信号、计数器106的频率控制信号、定时器105的频率控制信号、可配置逻辑阵列101的频率选择的控制信号和可配置逻辑阵列101的连接模块109的控制信号均由静态存储器组104控制;可配置逻辑模块108中的查找表107由若干个静态存储器组成。

3.根据权利要求1所述的功能可重构的数字系统,其特征在于:该系统使用数模混合技术组成;其中,微控制器模块102、串行外设接口模块103使用数字技术,用硬件描述语言完成;静态存储器组104、计数器106、定时器105和可配置逻辑阵列101使用模拟技术,用MOS管搭建而成。

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