[发明专利]GMSK调制装置及方法有效
| 申请号: | 201010153092.9 | 申请日: | 2010-04-20 |
| 公开(公告)号: | CN101834818A | 公开(公告)日: | 2010-09-15 |
| 发明(设计)人: | 叶晖;梁晓峰 | 申请(专利权)人: | 广州市广晟微电子有限公司 |
| 主分类号: | H04L25/03 | 分类号: | H04L25/03;H04L27/20 |
| 代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 逯长明 |
| 地址: | 510630 广东省广州市天*** | 国省代码: | 广东;44 |
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| 摘要: | |||
| 搜索关键词: | gmsk 调制 装置 方法 | ||
技术领域
本申请涉及移动通信技术领域,特别是涉及GMSK调制装置及方法。
背景技术
GMSK(Gaussian-filtered Minimum Shift Keying,高斯滤波最小移位键控)调制的基本工作原理是将基带信号先经过高斯滤波器成形,再进行最小频移键控(MSK)调制,由于GMSK调制的频谱特性优于MSK信号的频谱特性,因此在移动通信领域得到广泛应用。
GMSK调制的关键是根据输入的位元确定最终输出的调制信号的相位。
目前主要应用查表法实现GMSK调制,调制信号可以表示为s(t)=Acos(2pfct+j(t)),-?t<+□。j(t)可以表示为其中,ai为基带信号第i位数值,h为调制系数,g(t)为高斯滤波器的冲激响应。
对于由输入序列a={ak}组成相位j(t),当定义g(t)在全时间域内的积分为1时,在kT<t<(k+1)T内,j(t)可以表示为ai=q(t,a)+qa,其中,q(t)为相位函数,表示为q(t,a)为即时相位,qa为之前输入的数据流的所有符号累加得到的累加相位。现有技术中,把即时相位和累加相位组合构成查找表地址,根据该查找表地址从存放调制信号数据的查找表(查找表,Look Up Table),中,找到该查找表地址对应的调制信号数据。
在实现本申请的过程中,发明人发现现有技术中至少存在如下问题:现有技术中实现GMSK调制的查表法中的查找表仍需要占用大量的ROM空间,ROM空间越大其体积越大,因此占用芯片面积也越大,不适合在超大规模集成电路中应用。
发明内容
本申请实施例提供了一种GMSK调制装置及方法,以减小现有技术中实现GMSK调制的查表法中的查找表的ROM占用量,技术方案如下:
本申请实施例提供一种GMSK调制装置包括:第一数据处理模块、第一数据生成模块、第二数据生成模块、数据获取模块和第二数据处理模块;
所述第一数据处理模块,用于依据接收到的基带信号数据流进行移位处理,得到第一子集和第二子集,所述第一子集包含基带信号的即时相位信息,所述第二子集为将所述基带信号数据流进行移位处理得到的最高位数据;
所述第一数据生成模块,用于生成第一查找表地址的第一子地址;
所述第二数据生成模块,用于将所述第二子集进行累加,得到与所述基带信号的累加相位信息相对应的累加结果;
所述数据获取模块,用于依据所述第一查找表地址的第一子地址和第一查找表地址的第二子地址构成的第一查找表地址,获取该地址对应的初始调制信号数据,所述第一查找表地址的第二子地址为所述第一子集所包含的数据;
所述第二数据处理模块,用于依据所述累加结果的控制,将接收到的调制信号数据转换成最终调制信号数据。
优选地,上述装置中,所述第二数据处理模块,具体用于:
依据所述累加结果对应的累加相位信息,将接收到的调制信号数据进行角度旋转得到最终调制信号数据,所述累加相位信息为的整数倍。
优选地,上述装置中,还包括:
伪随机码生成模块,用于生成测试该GMSK调制装置的随机数据。
优选地,上述装置中,还包括:
差分编码器,用于对输入的数据流进行差分预编码。
本申请实施例提供另一种GMSK调制装置,包括:第一数据处理模块、第一数据生成模块、第二数据生成模块、第一反相器、数据获取模块、第二反相器、第二数据处理模块;
所述第一数据处理模块,用于依据接收到的基带信号数据流,进行移位处理得到第一子集和第二子集,所述第一子集包含所述基带信号,所述第二子集为将所述基带信号数据流进行移位处理得到的最高位数据;
所述第一数据生成模块,用于生成第二查找表地址的第一子地址;
所述第二数据生成模块,用于将所述第二子集进行累加,得到与所述基带信号的累加相位信息相对应的累加结果;
所述第一反相器,用于在所述第一子集的最高位数据的控制作用下,对第一子集的低三位数据进行按位取反处理,得到第二查找表地址的第二子地址,并输送至所述数据获取模块;
所述数据获取模块,用于依据所述第二查找表地址的第一子地址和第二查找表地址的第二子地址构成的第二查找表地址,获取该地址对应的初始调制信号数据,所述初始调制信号数据包括I支路输出数据I′和Q支路输出数据Q′;
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