[发明专利]一种电压切换电路无效
| 申请号: | 201010042677.3 | 申请日: | 2010-01-08 |
| 公开(公告)号: | CN102122884A | 公开(公告)日: | 2011-07-13 |
| 发明(设计)人: | 陈姿伶;何昆鹏;李学伟 | 申请(专利权)人: | 康佳集团股份有限公司 |
| 主分类号: | H02M3/155 | 分类号: | H02M3/155 |
| 代理公司: | 深圳市康弘知识产权代理有限公司 44247 | 代理人: | 胡朝阳;孙洁敏 |
| 地址: | 518055 广东*** | 国省代码: | 广东;44 |
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| 摘要: | |||
| 搜索关键词: | 一种 电压 切换 电路 | ||
1.一种电压切换电路,其特征在于,包括:
第一晶体管(V1),第二晶体管(V2),第三晶体管(V3),第四晶体管(V4),第五晶体管(V5),第一电阻(R1),第二电阻(R2),第三电阻(R3),第四电阻(R4),第五电阻(R5),第六电阻(R6),第七电阻(R7),其中,所述第一晶体管(V1),第二晶体管(V2)和第五晶体管(V5)均为NPN三极管,所述第三晶体管(V3)和第四晶体管(V4)均为PNP三极管;
所述第一晶体管(V1)的基极通过所述第二电阻(R2)连接控制信号的输入端,所述第一晶体管(V1)的集电极通过所述第三电阻(R3)连接第二电源电压端(U2)以及通过所述第四电阻(R4)连接所述第二晶体管(V2)的基极,所述第一晶体管(V1)的发射极接地,所述第一电阻(R1)的两端分别连接所述控制信号的输入端和所述第二电源电压端(U2);
所述第二晶体管(V2)的集电极通过所述第五电阻(R5)连接所述第三晶体管(V3)的基极,所述第二晶体管(V2)的发射极接地;
所述第五晶体管(V5)的基极通过所述第七电阻(R7)连接所述控制信号的输入端,所述第五晶体管(V5)的集电极通过所述第六电阻(R6)连接所述第四晶体管V4的基极,所述第五晶体管(V5)的发射极接地;
所述第三晶体管(V3)的集电极连接所述第四晶体管(V4)的集电极,并共同连接第一电源电压端(U1),所述第三晶体管(V3)的发射极连接所述第二电源电压端(U2),所述第四晶体管(V4)的发射极连接所述第三电源电压端(U3)。
2.如权利要求1所述的电路,其特征在于,开始工作时,所述第二电源电压端(U2)和第三电源电压端(U3)开始上电,且第三电源电压高于第二电源电压,负载电路由所述第一电源电压端(U1)供电。
3.如权利要求1所述的电路,其特征在于,正常工作后,由CPU产生控制信号,正常工作时控制信号为高电平,通过所述第二电阻(R2)输入到所述第一晶体管(V1)以及通过所述第七电阻(R7)输入到所述第五晶体管(V5),则所述第一晶体管(V1)导通,使得所述第一晶体管(V1)的集电极的电压拉低,所述第二晶体管(V2)和所述第三晶体管(V3)截止,所述第四晶体管(V4)和所述第五晶体管(V5)导通,第一电源电压端(U1)的电压由第三电源电压端(U3)提供,维持正常工作。
4.如权利要求1所述的电路,其特征在于,当需要进入待机模式时,CPU将控制信号置为低电平,所述第一晶体管(V1)处于截止状态,使得所述第一晶体管(V1)的集电极的电压经所述第三电阻(R3)拉高,使所述第二晶体管(V2)导通,进一步使所述第三晶体管(V3)也导通,所述第四晶体管(V4)和所述第五晶体管(V5)截止,第一电源电压端(U1)的电压由第二电源电压端(U2)提供,完成电压切换。
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