[发明专利]电平移位电路和方法无效

专利信息
申请号: 200980107089.9 申请日: 2009-01-28
公开(公告)号: CN101965684A 公开(公告)日: 2011-02-02
发明(设计)人: 陈南;里图·哈巴 申请(专利权)人: 高通股份有限公司
主分类号: H03K19/0185 分类号: H03K19/0185;H03K19/017;H03K3/356
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 宋献涛
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 电平 移位 电路 方法
【说明书】:

技术领域

发明大体上涉及电平移位电路和方法。

背景技术

技术的进步已带来更小且功能更强大的计算装置。举例来说,当前存在多种便携式个人计算装置,包含无线计算装置,例如便携式无线电话、个人数字助理(PDA)以及寻呼装置,其较小、重量轻且容易由用户携带。更具体来说,例如蜂窝式电话和因特网协议(IP)电话等便携式无线电话可经由无线网络传送语音和数据包。此外,许多此类无线电话包含并入于其中的其它类型的装置。举例来说,无线电话还可包含数字静态相机、数字视频相机、数字记录器以及音频文件播放器。而且,无线电话可处理可执行指令,包含软件应用程序,例如可用以接入因特网的网页浏览器应用程序。由此,这些无线电话可包含显著的计算能力。

为了减少便携式装置的功率消耗且因此延长其电池寿命,电源以日益降低的电压操作电子组件。虽然一些组件可在低电压下良好操作,但其它组件可能需要较高电压。因此,包含在不同电压下操作的组件的装置可使用电平移位器来在较高与较低电压之间转换信号。电平移位器电路设计常常需要在改良对输入转变的响应时间与改良低电压下的操作范围之间进行选择。响应时间的增加通常减小操作范围,而增加操作范围通常使响应时间降级。因此,电平移位器可限制装置在低功率操作期间的性能。

发明内容

在特定实施例中,揭示一种电路装置,所述电路装置包含:输入,其用以接收输入电压信号;以及输出,其用以提供经电平移位的电压信号。所述电路装置包含:第一弱态保持路径,其耦合到所述输入;以及第二弱态保持路径,其耦合到所述输出。所述电路装置还包含电压上拉逻辑电路,其耦合到所述第一弱态保持路径和所述第二弱态保持路径。所述电路装置进一步包含控制路径,其耦合到所述电压上拉逻辑电路以选择性地控制所述电压上拉逻辑电路的激活。

在另一实施例中,揭示一种系统,所述系统包含:存储器阵列;以及第一输入,其通过第一电平移位电路耦合到所述存储器阵列。所述系统还包含第二输入,其通过第二电平移位电路耦合到所述存储器阵列。所述第一电平移位电路包含:输入,其用以接收所述第一输入;以及输出,其用以将第一经电平移位的电压信号提供到所述存储器阵列。所述第一电平移位电路还包含第一弱态保持路径,其耦合到所述输入。所述第一电平移位电路进一步包含第二弱态保持路径,其耦合到所述输出。所述第一电平移位电路包含电压上拉逻辑电路,其耦合到所述第一弱态保持路径和第二弱态保持路径。所述第一电平移位电路还包含控制路径,其耦合到所述电压上拉逻辑电路以选择性地控制所述电压上拉逻辑电路的激活。

在另一实施例中,揭示一种装置,其包含用于在对包含电压上拉逻辑的电平移位电路的输入处接收输入电压的装置。所述装置还包含用于从所述电平移位电路提供输出信号的装置。所述装置进一步包含用于选择性地激活所述电平移位电路的所述电压上拉逻辑电路的装置。

在另一实施例中,揭示一种方法,其包含在对包含电压上拉逻辑的电平移位电路的输入处接收输入电压。所述方法包含从所述电平移位电路提供输出信号。所述方法还包含选择性地激活所述电平移位电路的所述电压上拉逻辑电路。

所揭示的实施例提供的一个特定优点是由于弱态保持路径而带来的大的电压移位范围以及由于电压上拉逻辑电路而带来的对输入信号转变的快速响应。另一特定优点是电平移位电路的操作相对能耐受工序的。

在审阅整个申请案之后将明了本发明的其它方面、优点和特征,申请案包含以下部分:附图说明、具体实施方式和权利要求书。

附图说明

图1是电平移位电路装置的第一说明性实施例的框图;

图2是电平移位电路装置的第二说明性实施例的电路图;

图3是包含电平移位电路装置的系统的特定说明性实施例的框图;

图4是使用电路装置(例如,图1到3中说明的电路装置)的电平移位的方法的特定说明性实施例的流程图;以及

图5是其中可使用图1到4中描述的电路和方法的实施例的代表性移动通信装置的框图。

具体实施方式

参见图1,描绘电平移位电路装置的第一说明性实施例,且其大体上指定为100。电平移位电路装置100包含用以接收输入电压信号的输入102。输出104提供经电平移位的电压信号。第一弱态保持路径106耦合到输入102且耦合到输出104。第一弱态保持路径106交叉耦合到第二弱态保持路径108,所述第二弱态保持路径108也耦合到输入102。电压上拉逻辑电路110耦合到第一弱态保持路径106和第二弱态保持路径108两者。控制路径112经耦合以将控制信号提供到电压上拉逻辑电路110。

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