[发明专利]固态图像拾取器件及其信号处理方法和图像拾取装置无效

专利信息
申请号: 200910146219.1 申请日: 2009-06-22
公开(公告)号: CN101610366A 公开(公告)日: 2009-12-23
发明(设计)人: 岩佐拓;绪方怜史 申请(专利权)人: 索尼株式会社
主分类号: H04N5/335 分类号: H04N5/335;H04N3/15;H04N5/225
代理公司: 北京市柳沈律师事务所 代理人: 郭定辉
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 固态 图像 拾取 器件 及其 信号 处理 方法 装置
【权利要求书】:

1.一种固态图像拾取器件,包含:

多个比较器,其被提供给具有以矩阵形式布置的、包含相应光电转换元件的单元像素的像素阵列部分,以便分别对应于像素列,每个所述比较器用于将经由对应一根垂直信号线而从对应一个所述单元像素输出的模拟信号与类似斜坡的基准信号相比较,以便将包含与对应一个模拟信号的大小相对应的时间信息的比较结果输出;

多个计数器,其均用来基于从对应一个所述比较器输出的时间信息,执行用于以一个时钟周期向最低有效位加1的计数操作,以便将得到的计数值输出为与对应一个模拟信号的大小相对应的数字信号;以及

控制部分,其用于以如下的方式执行控制:在加法模式的阶段中,将分别与两个像素列对应的两个比较器和两个计数器设置为单元,当来自该两个比较器的比较结果均具有第一逻辑时,向该两个计数器中的一个计数器的第二位加1,当来自该两个比较器的比较结果之一具有第一逻辑时,向该一个计数器的第一位加1,而当来自该两个比较器的比较结果均具有第二逻辑时,不向该一个计数器的第一位和第二位加1。

2.如权利要求1所述的固态图像拾取器件,其中,在加法模式的阶段中,所述控制部分停止对于所述两个计数器中的另一计数器中的位的计数操作。

3.一种固态图像拾取器件,包含:

多个比较器,其被提供给具有以矩阵形式布置的、包含相应光电转换元件的单元像素的像素阵列部分,以便分别对应于像素列,每个所述比较器用于将经由对应一根垂直信号线而从对应一个所述单元像素输出的模拟信号与类似斜坡的基准信号相比较,以便将包含与对应一个模拟信号的大小相对应的时间信息的比较结果输出;

多个计数器,其均用来基于从对应一个所述比较器输出的时间信息,执行用于以一个时钟周期向最低有效位加1的计数操作,以便将得到的计数值输出为与对应一个模拟信号的大小相对应的数字信号;以及

控制部分,其用于控制是否当在加法模式的阶段中将分别与三个或更多个像素列对应的三个或更多个比较器以及三个或更多个计数器设置为单元时,基于来自该三个或更多个比较器的比较结果以及该三个或更多个计数器中的一个计数器的第一位和第二位的值,向该三个或更多个计数器中的该一个计数器的第一至第三位均加1。

4.如权利要求3所述的固态图像拾取器件,其中,在加法模式的阶段中,所述控制部分停止对于除了所述一个计数器之外的每一个计数器中的位的计数操作。

5.一种固态图像拾取器件,包含:

多个比较器,其被提供给具有以矩阵形式布置的、包含相应光电转换元件的单元像素的像素阵列部分,以便分别对应于像素列,每个所述比较器用于将经由对应一根垂直信号线而从对应一个所述单元像素输出的模拟信号与类似斜坡的基准信号相比较,以便将包含与对应一个模拟信号的大小相对应的时间信息的比较结果输出;

多个计数器,其均用来基于从对应一个所述比较器输出的时间信息,执行用于以半个时钟周期向最低有效位加1的计数操作,以便将得到的计数值输出为与对应一个模拟信号的大小相对应的数字信号;以及

控制部分,其用于以如下的方式执行控制:在加法模式的阶段中,将分别与两个像素列对应的两个比较器和两个计数器设置为单元,当来自该两个比较器的比较结果均具有第一逻辑时,每半个时钟周期向该两个计数器中的一个计数器的第二位加1,当来自该两个比较器的比较结果之一具有第一逻辑时,每一个时钟周期向该一个计数器的第一位加1,而当来自该两个比较器的比较结果均具有第二逻辑时,不向该一个计数器的第二位加1。

6.如权利要求5所述的固态图像拾取器件,其中,该一个计数器的第二位的计数部分包含触发器,当来自该两个比较器的比较结果之一具有第一逻辑时,该触发器在时钟端接收与时钟信号同步的信号,而当来自该两个比较器的比较结果均具有第一逻辑时,该触发器在置位端和复位端接收均与时钟信号同步的信号。

7.如权利要求6所述的固态图像拾取器件,其中,在该一个计数器的第二位的计数部分中,向所述时钟端、所述置位端和所述复位端输入的信号是来自所述两个计数器中的另一计数器的最低有效位的计数部分的信号。

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