[发明专利]时钟信号生成电路、显示面板模块、成像装置和电子设备有效
申请号: | 200810178935.3 | 申请日: | 2008-12-05 |
公开(公告)号: | CN101453211A | 公开(公告)日: | 2009-06-10 |
发明(设计)人: | 千田满;水桥比吕志 | 申请(专利权)人: | 索尼株式会社 |
主分类号: | H03L7/06 | 分类号: | H03L7/06;G09G3/20;G09G3/36;G02F1/1362 |
代理公司: | 北京信慧永光知识产权代理有限责任公司 | 代理人: | 褚海英;武玉琴 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 时钟 信号 生成 电路 显示 面板 模块 成像 装置 电子设备 | ||
1.一种延迟同步环型时钟信号生成电路,其包括:
延迟线路,其用于将第一时钟信号以设定的延迟量延迟并输出;
延迟时长设定单元,其用于根据从输出端输出的第二时钟信号和所 述第一时钟信号之间的相位差设定所述延迟线路的延迟时长;
相位关系判定单元,其用于判断所述第一时钟信号和所述第二时钟 信号的相位关系是否为特定的相位关系;以及
相位反转/非反转单元,其用于当检测到所述特定的相位关系为所述 第二时钟信号的相位超前于所述第一时钟信号的相位的状态时,通过具 有一个反相器的传输通道输出所述第一时钟信号,对包括所述延迟线路 的传输线路上的所述第一时钟信号进行相位反转,且当检测到所述特定 的相位关系为所述第二时钟信号的相位滞后于所述第一时钟信号的相位 的状态时,通过具有两个反相器的另一个传输通道输出所述第一时钟信 号。
2.根据权利要求1所述的延迟同步环型时钟信号生成电路,其还包 括:
假锁定状态检测单元,其用于检测所述第一时钟信号和所述第二时 钟信号之间的假锁定状态;以及
假锁定状态解除单元,其用于当检测到所述假锁定状态时命令所述 相位反转/非反转单元进行相位反转。
3.根据权利要求1所述的延迟同步环型时钟信号生成电路,其中, 所述相位关系判定单元在复位时间段内判断是否已发生了所述的特定的 相位关系,并且在所述复位时间段结束后命令所述相位反转/非反转单元 进行反转或非反转。
4.根据权利要求1所述的延迟同步环型时钟信号生成电路,其中, 构成所述延迟同步环型时钟信号生成电路的有源元件利用薄膜形成技术 或印刷技术形成于绝缘基板上。
5.一种延迟同步环型时钟信号生成电路,其包括:
延迟线路,其用于将第一时钟信号以设定的延迟量延迟并输出;
延迟时长设定单元,其用于根据从输出端输出的第二时钟信号和所 述第一时钟信号之间的相位差设定所述延迟线路的延迟时长;
相位关系判定单元,其用于判断所述第一时钟信号和所述第二时钟 信号的相位关系是否为特定的相位关系;以及
相位反转/非反转单元,其用于当检测到所述特定的相位关系为所述 第二时钟信号的相位滞后于所述第一时钟信号的相位的状态时,通过具 有一个反相器的传输通道输出所述第一时钟信号,对包括所述延迟线路 的传输线路上的所述第一时钟信号进行相位反转,且当没有检测到所述 特定的相位关系为所述第二时钟信号的相位超前于所述第一时钟信号的 相位的状态时,通过具有两个反相器的另一个传输通道输出所述第一时 钟信号。
6.根据权利要求5所述的延迟同步环型时钟信号生成电路,其还包 括:
假锁定状态检测单元,其用于检测所述第一时钟信号和所述第二时 钟信号之间的假锁定状态;以及
假锁定状态解除单元,其用于当检测到所述假锁定状态时命令所述 相位反转/非反转单元进行相位反转。
7.根据权利要求5所述的延迟同步环型时钟信号生成电路,其中, 所述相位关系判定单元在复位时间段内判断是否已发生了所述的特定的 相位关系,并且在所述复位时间段结束后命令所述相位反转/非反转单元 进行反转或非反转。
8.根据权利要求5所述的延迟同步环型时钟信号生成电路,其中, 构成所述延迟同步环型时钟信号生成电路的有源元件利用薄膜形成技术 或印刷技术形成于绝缘基板上。
9.一种显示面板模块,其包括:
显示面板;
如权利要求1-8之一所述的延迟同步环型时钟信号生成电路;以及
驱动电路,其用于基于所述第二时钟信号驱动所述显示面板。
10.根据权利要求9所述的显示面板模块,其中,所述时钟信号生成 电路的有源元件是形成或印刷于绝缘基板上的薄膜晶体管。
11.根据权利要求9所述的显示面板模块,其中,所述显示面板是液晶 面板。
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