[发明专利]半导体存储器件和数据存储方法无效
| 申请号: | 200810144032.3 | 申请日: | 2008-07-23 | 
| 公开(公告)号: | CN101383184A | 公开(公告)日: | 2009-03-11 | 
| 发明(设计)人: | 石崎达也;中村博功;黑川敬之;牛越谦一 | 申请(专利权)人: | 恩益禧电子股份有限公司 | 
| 主分类号: | G11C8/00 | 分类号: | G11C8/00;G11C8/10;G11C8/06 | 
| 代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 陆锦华;黄启行 | 
| 地址: | 日本*** | 国省代码: | 日本;JP | 
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| 摘要: | |||
| 搜索关键词: | 半导体 存储 器件 数据 方法 | ||
1.一种半导体存储器件,用于基于数据的坐标信息来存储限定多维空间的数据,所述半导体存储器件包括:
单元阵列,包括以网格模式排列的存储单元,用于存储所述数据;
字线选择器,用于选择和驱动多条字线的任何一条以激活在行方向上排列的所述存储单元;
多个写入放大器和多个读出放大器,用于向在列方向上排列的所述存储单元写入数据和从其读取数据;
放大器选择器,用于选择所述多个写入放大器的任何一个和所述多个读出放大器的任何一个,以便向所述多个写入放大器的所选择的一个输入所述数据和从所述多个读出放大器的所选择的一个输出所述数据;以及
地址转换电路,用于根据所述数据的所述坐标信息产生要向所述字线选择器提供的行地址,并且通过将所述数据的所述坐标信息转换为一维信息来产生要向所述放大器选择器提供的列地址。
2.根据权利要求1所述的半导体存储器件,其中,所述地址转换电路通过使用具有共同值的多个数据的比特值作为指示所述坐标信息的地址值,来产生行地址。
3.根据权利要求1所述的半导体存储器件,其中,所述地址转换电路通过使用具有不同值的多个数据的比特值的组合作为指示所述坐标信息的地址值,来产生所述列地址。
4.根据权利要求1所述的半导体存储器件,其中,所述地址转换电路向与所述数据相关联的输入/输出端子编号分配端子地址,以使用所述端子地址和所述坐标信息的组合来产生所述列地址。
5.根据权利要求1所述的半导体存储器件,其中,所述地址转换电路当通过使用多个比特设置所述数据的值时,向所述多个比特的每个比特分配数据地址,以通过使用所述数据地址和所述坐标信息的组合来产生所述列地址。
6.根据权利要求1所述的半导体存储器件,其中,所述地址转换电路将所述空间的大小划分为小空间,每个小空间具有通过使用由2的幂表示的数据的数量限定的大小,并且所述地址转换电路向用于表示每个所述小空间的编号分配小空间地址,以通过使用所述小空间地址和所述坐标信息的组合来产生所述列地址。
7.根据权利要求1所述的半导体存储器件,其中,所述地址转换电路包括对应于所述数据的所述空间的每个大小的多个图像映射电路,并且响应于用于指定所述数据的所述空间的大小的图像大小选择信号来选择所述图像映射电路之一。
8.根据权利要求7所述的半导体存储器件,其中,所述多个图像映射电路每个都根据对于所述数据的所述空间的每个大小预先规定的规则执行地址转换。
9.根据权利要求1所述的半导体存储器件,其中,所述半导体存储器件执行突发操作,以顺序地输入和输出多个数据。
10.根据权利要求1所述的半导体存储器件,其中,所述半导体存储器件执行全页面操作,以通过一次地址输入访问连接到单条字线的多个存储单元。
11.根据权利要求1所述的半导体存储器件,还包括复位控制电路,用于控制所有的所述存储单元使之在将所述数据写入到所述多个存储单元之前进入复位状态。
12.根据权利要求1所述的半导体存储器件,其中,所述半导体存储器件被形成在半导体基板上,所述半导体基板具有与其他功能块不同的所述地址转换电路。
13.根据权利要求12所述的半导体存储器件,还包括:锁存电路,用于暂时存储从发送侧器件向所述地址转换电路的前级发送的地址数据,以便响应于从所述发送侧器件发送的命令信号而向所述地址转换电路发送从所述地址数据当中选择的地址数据,所述命令信号用于指定所述半导体存储器件的操作。
14.一种用于半导体存储器件的数据存储方法,所述半导体存储器件包括具有以网格模式排列的存储单元的单元阵列,用于根据数据的坐标信息来存储限定多维空间的数据,所述数据存储方法包括:
基于所述数据的所述坐标信息当中的单个坐标信息来确定存储所述数据的行地址;并且
基于被转换为一维信息的所述坐标信息来确定存储所述数据的列地址。
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