[发明专利]具有用于实速转换故障测试多内核的通用时钟控制模块的多时钟片基系统无效

专利信息
申请号: 200780031829.6 申请日: 2007-08-29
公开(公告)号: CN101512363A 公开(公告)日: 2009-08-19
发明(设计)人: 保罗-亨利·普列西-孔蒂;埃尔夫·樊尚 申请(专利权)人: NXP股份有限公司
主分类号: G01R31/3185 分类号: G01R31/3185;G01R31/317
代理公司: 北京天昊联合知识产权代理有限公司 代理人: 陈 源;张天舒
地址: 荷兰艾*** 国省代码: 荷兰;NL
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摘要:
搜索关键词: 具有 用于 转换 故障测试 内核 通用 时钟 控制 模块 多时 钟片基 系统
【权利要求书】:

1.多时钟片基系统(D),包括:至少一个内核(CE),所述内核包 括至少两个为了在其间交换测试数据而设的异步时钟域;时钟发生器 单元(CGU),安排为用于为所述时钟域中的至少一部分供应主时钟信 号;和至少两个时钟控制模块(CCi),所述时钟控制模块分别安排为 用于根据所述主时钟信号和根据控制信号定义所述功能时钟信号,所 述控制信号用于将所述时钟控制模块(CCi)设定为正常模式或移位模 式,正常模式允许测试数据从起到发出方作用的相应时钟域传送到至 少一个接收方时钟域,移位模式将测试时钟强加到所述功能时钟信号 上,以实现扫描链移位,所述多时钟片基系统(D)特征在于,各个时 钟控制模块(CCi)与下列部件相连接:i)同步装置(SM),该同步装置安 排为用于在接收到所述控制信号时,将所述时钟控制模块(CCi)从所 述移位模式切换到所述正常模式,和ii)延迟装置(DM),该延迟装置 安排为用于在将所述时钟控制模块(CCi)设定为所述正常模式的时 候,将供发出方时钟域使用的功能时钟信号的发出方投送边沿推后, 以使所述发出方投送边沿暂时位于供一个或多个接收方时钟域使用 的一个或多个时钟信号的各个相应接收方采集边沿之前,所述接收方 时钟域是所述发出方时钟域必须要将测试数据发送到的时钟域。

2.按照权利要求1所述的多时钟片基系统,其特征在于,所述延 迟装置(DM)安排为用于将供所述发出方时钟域(CD1)使用的功能时 钟信号(FS1)的发出方投送边沿推后一个时间段,该时间段至少等于 所述发出方投送边沿和供一个或多个接收方时钟域(CD2,CD3)使用 的一个或多个相应功能时钟信号(FS2,FS3)的采集边沿之间的最远时 间距离。

3.电子设备,其特征在于,它包括至少一个按照前列权利要求之 一所述的多时钟片基系统(D)。

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