[发明专利]功率IC器件及其制造方法有效
| 申请号: | 200780020846.X | 申请日: | 2007-05-31 |
| 公开(公告)号: | CN101461062A | 公开(公告)日: | 2009-06-17 |
| 发明(设计)人: | A·O·阿丹;菊田光洋;寺本章伸;大见忠弘;矢部弘男;渡边高训 | 申请(专利权)人: | 夏普株式会社;国立大学法人东北大学;矢崎总业株式会社 |
| 主分类号: | H01L27/088 | 分类号: | H01L27/088;H01L21/8238;H01L21/336;H01L27/092;H01L21/8234;H01L29/78 |
| 代理公司: | 上海专利商标事务所有限公司 | 代理人: | 张 鑫 |
| 地址: | 日本*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 功率 ic 器件 及其 制造 方法 | ||
1.一种功率IC器件,其中,表层沟道MOS晶体管和P沟道型沟槽功率MOS 晶体管形成于同一个芯片,该功率IC器件的特征在于,
上述芯片表面的面方位为偏离硅(110)结晶面-8°以上+8°以下的面方位;
上述P沟道型沟槽功率MOS晶体管具有:沟槽,通过在上述芯片的表面进 行垂直穿孔形成,使得该沟槽的横壁的至少一个面的面方位为偏离硅(110) 结晶面-8°以上+8°以下的面方位;栅区,形成于上述沟槽内;沟槽功率MOS 晶体管反型沟区,形成于上述沟槽的横壁部分;源区,形成于上述沟槽功率MOS 晶体管反型沟区之上层的芯片表面层,并借助于栅极绝缘膜实现与上述栅区之 间的绝缘;以及漏区,形成于上述沟槽功率MOS晶体管反型沟区之下层的芯片 背面层,
电流从上述源区经上述沟槽功率MOS晶体管反型沟区沿着偏离硅<110>结 晶方向-8°以上+8°以下的方向流入上述漏区;
上述表层沟道MOS晶体管为P型表层沟道MOS晶体管;
形成有表层沟道MOS晶体管反型沟区,其中,反型沟道电流沿着与上述芯 片的表面平行的方向流经上述芯片的表面部分,该方向偏离硅<110>结晶方向-8 °以上+8°以下。
2.根据权利要求1所述的功率IC器件,其特征在于:
上述P型表层沟道MOS晶体管通过形成一对N型表层沟道MOS晶体管来构 成表层沟道CMOS晶体管。
3.一种功率IC器件,其中,表层沟道MOS晶体管和P沟道型沟槽功率MOS 晶体管形成于同一个芯片,该功率IC器件的特征在于,
上述芯片表面的面方位为偏离硅(110)结晶面-8°以上+8°以下的面方位;
上述P沟道型沟槽功率MOS晶体管具有:沟槽,通过在上述芯片的表面进 行垂直穿孔形成,使得该沟槽的横壁的至少一个面的面方位为偏离硅(110) 结晶面-8°以上+8°以下的面方位;栅区,形成于上述沟槽内;沟槽功率MOS 晶体管反型沟区,形成于上述沟槽的横壁部分;源区,形成于上述沟槽功率MOS 晶体管反型沟区之上层的芯片表面层,并借助于栅极绝缘膜实现与上述栅区之 间的绝缘;以及漏区,形成于上述沟槽功率MOS晶体管反型沟区之下层的芯片 背面层,
电流从上述源区经上述沟槽功率MOS晶体管反型沟区沿着偏离硅<110>结 晶方向-8°以上+8°以下的方向流入上述漏区;
上述表层沟道MOS晶体管为N型表层沟道MOS晶体管;
形成有表层沟道MOS晶体管反型沟区,其中,反型沟道电流沿着与上述芯 片的表面平行的方向流经上述芯片的表面部分,该方向偏离硅<100>结晶方向-8 °以上+8°以下。
4.根据权利要求3所述的功率IC器件,其特征在于:
上述N型表层沟道MOS晶体管通过形成一对P型表层沟道MOS晶体管来构 成表层沟道CMOS晶体管。
5.根据权利要求1至4中任意一项所述的功率IC器件,其特征在于:
上述P沟道型沟槽功率MOS晶体管具有多个并排设置的沟槽,其中,该沟 槽的横壁的面方位与偏离硅(110)结晶面-8°以上+8°以下的面方位平行。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的





