[发明专利]数据选通定时补偿无效
申请号: | 200710199176.4 | 申请日: | 2007-12-18 |
公开(公告)号: | CN101206911A | 公开(公告)日: | 2008-06-25 |
发明(设计)人: | C·H·郑;S·卡雷纳哈里;Z·博金 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G11C7/10 | 分类号: | G11C7/10;G06F13/14 |
代理公司: | 永新专利商标代理有限公司 | 代理人: | 王英 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 数据 定时 补偿 | ||
1.一种方法,包括:
在至少一个互连中的第一互连上从存储器接收数据;
从所述存储器接收源同步数据选通;
根据所接收的数据选通,创建至少一个标称、提前和延迟的补偿数据选通;
使用所述标称、提前或延迟的补偿数据选通来锁存所接收的数据;
将所述锁存数据输出到所述至少一个互连中的一个或多个上。
2.根据权利要求1所述的方法,还包括:
基于所接收的数据和所接收的数据选通之间的对齐,选择所述标称、提前或延迟的补偿数据选通来锁存所接收的数据。
3.根据权利要求2所述的方法,还包括:
将所述补偿数据选通分割为四个除二选通,每一个都是通过在每隔一个上升或下降沿上对所接收的数据选通进行采样来创建的;以及
将所接收的数据分割到进入缓冲器的四个分离的内部互连上,其中,所述四个内部互连中的每一个保持在所述存储器互连上发送的每隔三个数据单元。
4.根据权利要求3所述的方法,其中,所述四个除二选通是四重交错的,每一个都用于锁存进入所述缓冲器的每隔三个数据单元。
5.根据权利要求4所述的方法,其中,每个所述四重交错除二选通均与前一个除二选通交错了半个所接收的数据选通周期。
6.根据权利要求3所述的方法,还包括:
在相关联的内部互连上,保持每个数据单元在所接收的数据选通的两个完整周期内有效。
7.一种装置,包括:
缓冲器,用于存储数据;
数据选通容差单元,用于:
在至少一个互连中的第一互连上从存储器接收数据;
从所述存储器接收源同步数据选通;
根据所接收的数据选通,创建至少一个标称、提前和延迟的补偿数据选通;
基于所接收的数据和所接收的数据选通之间的定时对齐,选择所述标称、提前或延迟的补偿数据选通,来将所接收的数据锁存在所述缓冲器中;
将所接收的数据从所述缓冲器输出到所述至少一个互连中的一个或多个。
8.根据权利要求7所述的装置,其中,所述数据选通容差单元还用于:
将所述补偿数据选通分割为四个除二选通,每一个都是通过在每隔一个上升或下降沿上对所接收的数据选通进行采样来创建的;以及
将所接收的数据分割到进入所述缓冲器的四个分离的内部互连上,其中,所述四个内部互连中的每一个保持在所述第一外部互连上发送的每隔三个数据单元。
9.根据权利要求8所述的装置,其中,所述四个除二选通是四重交错的,每一个都用于锁存进入所述缓冲器的每隔三个数据单元。
10.根据权利要求9所述的装置,其中,每个所述四重交错除二选通均与前一个除二选通交错了半个所接收的数据选通周期。
11.根据权利要求10所述的装置,其中,所述数据选通容差逻辑还用于:
在相关联的内部互连上,保持每个数据单元在所接收的数据选通的两个完整周期内有效。
12.根据权利要求8所述的装置,其中,所述数据选通容差逻辑还用于:
在相关联的内部互连上保持每个数据单元有效,直到从所述第一互连接收到跟在所给定的单个数据单元之后的第四个数据单元。
13.根据权利要求8所述的装置,其中,所述数据单元的宽度为8字节。
14.一种系统,包括:
互连;
耦合到所述互连的处理器;
耦合到所述互连的存储器;
耦合到所述互连的芯片组,其中,所述芯片组还包括数据选通容差逻辑,用于:
在所述互连上从所述存储器接收数据;
从所述存储器接收数据选通;
根据所接收的数据选通,创建至少一个标称、提前和延迟的补偿数据选通;
基于所接收的数据和所接收的数据选通之间的定时对齐,选择所述标称、提前或延迟的补偿数据选通,来将所接收的数据锁存在缓冲器中;以及
将所接收的数据从所述缓冲器输出到所述互连;
耦合到所述芯片组的第二互连;以及
耦合到所述第二互连的网络接口卡。
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