[发明专利]形成半导体存储器件位线的方法有效
| 申请号: | 200710088223.8 | 申请日: | 2007-03-15 |
| 公开(公告)号: | CN101140900A | 公开(公告)日: | 2008-03-12 |
| 发明(设计)人: | 郑哲谟;赵挥元;金正根;洪承希 | 申请(专利权)人: | 海力士半导体有限公司 |
| 主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L21/321;H01L21/3213 |
| 代理公司: | 北京集佳知识产权代理有限公司 | 代理人: | 顾晋伟;刘继富 |
| 地址: | 韩国京畿*** | 国省代码: | 韩国;KR |
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| 摘要: | |||
| 搜索关键词: | 形成 半导体 存储 器件 方法 | ||
1.一种形成半导体存储器件位线的方法,所述方法包括:
在半导体衬底上形成第一绝缘层;
蚀刻所述第一绝缘层的区域以形成暴露部分所述半导体衬底的接触孔;
在所述接触孔上形成阻挡层;
在所述阻挡层上和所述接触孔中沉积低电阻钨层以形成接触塞;
实施化学机械抛光(CMP)工艺以抛光所述低电阻钨层,而不暴露所述低电阻钨层下的阻挡层;和
将所述低电阻钨层图案化为包括位线和接触塞的位线金属图案。
2.权利要求1的方法,其中所述低电阻钨层形成的厚度为1500~2000埃。
3.权利要求1的方法,其中所述低电阻钨层的电阻值为9~12Ω·μm。
4.权利要求1的方法,其中在钨沉积步骤的成核步骤中,通过掺杂B2H6或SiH4或二者而形成所述低电阻钨层,以增加块体钨的晶粒尺寸。
5.权利要求1的方法,其中使所述低电阻钨层图案化包括:
在所述低电阻钨层上形成包括SiON层、α-碳层和抗反射层的硬掩模图案;和
使用所述硬掩模图案蚀刻所述低电阻钨层。
6.权利要求1的方法,还包括在形成所述位线后通过HDP工艺或SOG工艺形成第二绝缘层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





