[发明专利]使用多组地址/数据线的存储器访问无效
| 申请号: | 200580045887.5 | 申请日: | 2005-11-14 |
| 公开(公告)号: | CN101151603A | 公开(公告)日: | 2008-03-26 |
| 发明(设计)人: | J·-H·奥 | 申请(专利权)人: | 奇梦达股份公司 |
| 主分类号: | G06F13/16 | 分类号: | G06F13/16 |
| 代理公司: | 北京康信知识产权代理有限责任公司 | 代理人: | 余刚;李丙林 |
| 地址: | 德国*** | 国省代码: | 德国;DE |
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| 摘要: | |||
| 搜索关键词: | 使用 地址 数据线 存储器 访问 | ||
1.一种用于访问具有多个地址模式的存储装置的方法,包括:
如果选择了单地址模式,
则在第一和第二组线上接收单地址的多个部分,
使用所述单地址来访问所述存储装置的第一和第二存储器阵列并使用第一和第二组线接收或发送数据;以及
如果选择了多地址模式,
则在第一和第二组线上接收第一和第二地址的多个部分,
使用第一地址来访问第一存储器阵列并使用第一组线接收或发送数据,以及
使用第二地址来访问第二存储器阵列并使用第二组线接收或发送数据。
2.如权利要求1所述的方法,包括接收标识所选的地址模式的一个或多个控制信号。
3.如权利要求2所述的方法,其特征在于,所述一个或多个控制信号包括至少一个地址有效信号。
4.如权利要求1所述的方法,其特征在于,在所述多地址模式中在第一和第二组线上接收第一和第二地址的多个部分包括:
在连续时钟周期内在第一组线上接收第一地址的第一和第二部分;以及
在连续时钟周期内在第二组线上接收第二地址的第一和第二部分。
5.如权利要求1所述的方法,其特征在于,在所述多地址模式中在第一和第二组线上接收第一和第二地址的多个部分包括:
在单个时钟周期内与连续时钟沿同时地在第一组线上接收第一地址的第一和第二部分;以及
在所述单个时钟周期内与所述连续时钟沿同时地在第二组线上接收第二地址的第一和第二部分。
6.一种用于访问存储装置的方法,包括:
在第一和第二组线上接收第一和第二地址的多个部分;
使用第一地址来访问所述存储装置的第一存储器阵列并使用第一组线接收或发送数据;以及
使用第二地址来访问所述存储装置的第二存储器阵列并使用第二组线接收或发送数据。
7.如权利要求6所述的方法,其特征在于,在第一和第二组线上接收第一和第二地址的多个部分包括:
在连续时钟周期内在第一组线上接收第一地址的第一和第二部分;以及
在连续时钟周期内在第二组线上接收第二地址的第一和第二部分。
8.如权利要求6所述的方法,其特征在于,在第一和第二组线上接收第一和第二地址的多个部分包括:
在第一时钟周期内在第一和第二组线上接收第一地址的第一和第二部分;以及
在第二时钟周期内在第一和第二组线上接收第二地址的第一和第二部分。
9.如权利要求6所述的方法,包括:
通过连接第一地址的多个部分来生成第一地址;以及
通过连接第一地址的多个部分来生成第二地址。
10.如权利要求6所述的方法,还包括经由第三组线接收第一和第二地址的部分。
11.如权利要求10所述的方法,其特征在于,所述第三组线包括专用的地址线。
12.一种设备,包括:
可独立寻址的第一和第二存储器阵列;
第一和第二组地址/数据线;以及
电路,配置为:
在第一地址模式中,在第一和第二组地址/数据线上接收单地址的多个部分,使用所述单地址来访问存储装置的第一和第二存储器阵列并使用第一和第二组地址/数据线接收或发送数据,以及
在第二地址模式中,在第一和第二组地址/数据线上接收第一和第二地址的多个部分,使用第一地址来访问第一存储器阵列并使用第一组地址/数据线接收或发送数据,以及使用第二地址来访问第二存储器阵列并使用第二组地址/数据线接收或发送数据。
13.如权利要求12所述的设备,其特征在于,所述电路配置为接收选择地址模式的一个或多个控制信号。
14.如权利要求12所述的设备,其特征在于,所述电路配置为在第二地址模式中:
在连续时钟周期内在第一组线上接收第一地址的第一和第二部分;以及
在连续时钟周期内在第二组线上接收第二地址的第一和第二部分。
15.如权利要求12所述的设备,其特征在于,所述电路配置为在第一地址模式中通过连接所述单地址的多个部分来生成所述单地址。
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