[发明专利]时钟同步控制检验装置无效
| 申请号： | 94106447.6 | 申请日： | 1994-06-10 |
| 公开（公告）号： | CN1099539A | 公开（公告）日： | 1995-03-01 |
| 发明（设计）人： | 齐藤成利 | 申请（专利权）人： | 株式会社东芝 |
| 主分类号： | H04L7/033 | 分类号： | H04L7/033 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 傅康,叶恺东 |
| 地址： | 日本神*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明的数字基带信号接收装置的时钟同步控制的试验检验装置不必将数字调制器产生的数字数据变换为模拟信号，就可以给出数字式的任意的相位误差，从而可以很容易地实现时钟同步控制检验。用数字滤波器构成用于抑制码间干扰的滤波器，将该滤波器系数组按脉冲响应沿时间轴偏离的形式备有多组，设有用于选择其中的一组的系数控制装置。这样，通过选择滤波器的滤波器系数，可以对数字信号任意给出相位偏移。 | ||
| 搜索关键词： | 时钟 同步 控制 检验 装置 | ||
【主权项】：
1、数字基带信号接收装置的时钟同步控制检验装置，其特征在于：用于抑制码间干扰的第1数字滤波装置、用于将调制接收信号进行解调的检波装置、对上述检波装置的检波输出信号的判别装置、对其检波输出信号眼图的相位偏移的检测装置和选择上述第1数字滤波装置的滤波器系数的系数控制装置。
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