[发明专利]高效的多线程并行计算处理器数据缓存的设计方法和装置在审
| 申请号： | 202310023812.7 | 申请日： | 2023-01-09 |
| 公开（公告）号： | CN116302111A | 公开（公告）日： | 2023-06-23 |
| 发明（设计）人： | 钟伟;王文捷;陈千里 | 申请（专利权）人： | 深圳中微电科技有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38;G06F9/48 |
| 代理公司： | 深圳市添源创鑫知识产权代理有限公司 44855 | 代理人： | 朱丽萍 |
| 地址： | 518000 广东省深圳市南山区粤*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供了一种高效的多线程并行计算处理器数据缓存的设计方法及装置，该设计方法包括以下步骤：步骤1，线程的划分步骤；每个时钟周期把多个线程按数据地址划分到不同bank上，然后同时发送多个线程的LS指令及其线程ID到数据缓存处理步骤；步骤2，数据缓存处理步骤；如果线程命中的话，缓存下个时钟周期同时返回多个线程的数据，如果线程不全命中的话，则将不命中的信号分别发送到线程的划分步骤和线程管理步骤进行处理，随后把不命中访问地址及其线程ID压入MISS FIFO中，处理MISS FIFO中的每个地址，处理完毕后唤醒对应的线程；步骤3，线程管理步骤。本发明的有益效果是：能高效处理多线程并行计算处理器的数据请求，代价小，并行性能好。 | ||
| 搜索关键词： | 高效 多线程 并行 计算 处理器 数据 缓存 设计 方法 装置 | ||
【主权项】：
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