[发明专利]一种基于PCIE通道的多算法IP核的高速加解密系统及方法有效
| 申请号： | 202210572363.7 | 申请日： | 2022-05-25 |
| 公开（公告）号： | CN114662136B | 公开（公告）日： | 2022-09-20 |
| 发明（设计）人： | 王亮;何军;颜昕明 | 申请（专利权）人： | 广州万协通信息技术有限公司 |
| 主分类号： | G06F21/60 | 分类号： | G06F21/60;G06F13/28;H04L9/00 |
| 代理公司： | 北京市盛峰律师事务所 11337 | 代理人： | 于国富 |
| 地址： | 510400 广东省广州市白云区北太路1633*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种基于PCIE通道的多算法IP核的高速加解密系统及方法，在本发明设计方案下，PCIE加解密芯片所有的加解密业务是基于算法IP核X驱动的，芯片内部可用算法核的状态寄存器ALG_KERNEL_IDLE_Reg位于PCIe内存空间中，便于上位机PCIe驱动使用配置，用户的加解密源数据存储在上层主机系统内存中，由PCIE加解密芯片内部的DMA主动进行读取源数据，算法IP核进行加解密运算，完成后由内部DMA主动将加解密后的数据写回到同一内存中，直到将目标数据全部处理完毕后，最后产生PCIe MSI中断，ISR向“算法核完成状态消息对列”写入消息，唤醒用户线程，从而完成全部加解密工作,同时算法IP核被释放成空闲可用状态。 | ||
| 搜索关键词： | 一种 基于 pcie 通道 算法 ip 高速 解密 系统 方法 | ||
【主权项】：
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