[发明专利]FPGA动态并行加卸载系统有效
| 申请号： | 202210110329.8 | 申请日： | 2022-01-29 |
| 公开（公告）号： | CN114443170B | 公开（公告）日： | 2023-10-24 |
| 发明（设计）人： | 顾昇;周海兵;郭昊;王晓鹏;逯姣姣;刘代阳;杨舟 | 申请（专利权）人： | 中国航空无线电电子研究所 |
| 主分类号： | G06F9/445 | 分类号： | G06F9/445 |
| 代理公司： | 上海和跃知识产权代理事务所(普通合伙) 31239 | 代理人： | 杨慧 |
| 地址： | 200233 *** | 国省代码： | 上海;31 |
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| 摘要： | 本发明公开了一种FPGA动态并行加卸载系统，包含一个主控CPU，一个代理FPGA和若干个待加载FPGA；主控CPU内部的DMA通过主控SRIO控制器将各待加载FPGA的配置数据按设置好的单次传输字节轮流发送给代理FPGA；代理FPGA内部的代理SRIO控制器将接收到的各待加载FPGA的配置数据并写入各对应的待加载FPGA的虚拟链路上FIFO，再由各虚拟链路上SelectMap控制器按SelectMap时序从FIFO读取出待加载FPGA的配置数据发送给待加载FPGA。本发明可以在不降低加载带宽的前提下对多片FPGA并行加载，起到了对SRIO带宽分时复用的作用。 | ||
| 搜索关键词： | fpga 动态 并行 卸载 系统 | ||
【主权项】：
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