[发明专利]一种多bit输入与多bit权重乘累加的存内计算单元有效
| 申请号： | 202110238050.3 | 申请日： | 2021-03-04 |
| 公开（公告）号： | CN112599165B | 公开（公告）日： | 2021-06-29 |
| 发明（设计）人： | 乔树山;李润成;尚德龙;周玉梅 | 申请（专利权）人： | 中科院微电子研究所南京智能技术研究院 |
| 主分类号： | G11C11/413 | 分类号： | G11C11/413 |
| 代理公司： | 北京高沃律师事务所 11569 | 代理人： | 杜阳阳 |
| 地址： | 211100 江苏省南京市江宁*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明涉及一种多bit输入与多bit权重乘累加的存内计算单元，其特征在于，包括输入端、多个6管SRAM存储单元、累加电容和输出线；各所述6管SRAM存储单元的字线分别与所述输入端连接，各所述6管SRAM存储单元的位线通过开关与所述累加电容的第一端连接，所述累加电容的第一端通过开关与输出线连接；所述输入端用于输入不同脉宽的输入信号，所述累加电容用于累加各所述6管SRAM存储单元的位线上的电压。本发明实现了减小了面积的多位运算。 | ||
| 搜索关键词： | 一种 bit 输入 权重 累加 计算 单元 | ||
【主权项】：
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