[发明专利]一种修正建立时间违反的方法、装置及系统在审
| 申请号： | 202011531396.4 | 申请日： | 2020-12-22 |
| 公开（公告）号： | CN112564682A | 公开（公告）日： | 2021-03-26 |
| 发明（设计）人： | 韦秋初;黄运新 | 申请（专利权）人： | 深圳大普微电子科技有限公司 |
| 主分类号： | H03K17/28 | 分类号： | H03K17/28 |
| 代理公司： | 深圳市深佳知识产权代理事务所(普通合伙) 44285 | 代理人： | 陈彦如 |
| 地址： | 518000 广东省深圳市龙岗*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种修正建立时间违反的方法、装置及系统，在对建立时间违反路径上的逻辑器件进行替换时，按照延迟功耗权重比从大到小的顺序依次将逻辑器件替换为替换逻辑器件，并在每次替换后将路径余量更新为路径余量与本次替换的替换逻辑器件的延迟减小量的和，直至更新后的路径余量大于0或者所有逻辑器件均被替换完。可见，该方法替换同类型逻辑器件的技术上，还考虑了替换逻辑器件的功耗，由于延迟功耗权重比越大，说明替换逻辑器件后获得的延迟收益大而增加的漏电功耗少，可见，按照延迟功耗权重比从大到小的顺序进行器件替换能够在较快修正建立时间的基础上还减少漏电功耗的增加，提高了修正建立时间违反的效率。 | ||
| 搜索关键词： | 一种 修正 建立 时间 违反 方法 装置 系统 | ||
【主权项】：
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