[发明专利]通孔结构的制备方法以及三维存储器的制备方法在审
申请号: | 201911296397.2 | 申请日: | 2019-12-16 |
公开(公告)号: | CN110707009A | 公开(公告)日: | 2020-01-17 |
发明(设计)人: | 霍宗亮;姚兰;杨号号;高晶;周文斌 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L21/311 | 分类号: | H01L21/311;H01L27/115 |
代理公司: | 11270 北京派特恩知识产权代理有限公司 | 代理人: | 高洁;张颖玲 |
地址: | 430074 湖北省武*** | 国省代码: | 湖北;42 |
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摘要: | 本发明实施例提供了一种通孔结构的制备方法,包括:提供包括第一堆叠层的基底结构;刻蚀第一堆叠层,形成第一通孔;在第一通孔底部形成外延生长层;在第一通孔内形成刻蚀阻挡层,刻蚀阻挡层至少覆盖外延生长层的表面;在第一通孔内形成填充结构;在第一堆叠层上形成第二堆叠层;刻蚀第二堆叠层,形成连通第一通孔的第二通孔;刻蚀以去除第一通孔内的填充结构;其中,刻蚀阻挡层的材料与以下任意之一的材料之间的刻蚀选择比满足刻蚀阻挡要求:第二堆叠层、填充结构、填充结构的氧化层。此外,本发明实施例还提供了一种三维存储器的制备方法,包括上述通孔结构的制备方法中的步骤。 | ||
搜索关键词: | 通孔 堆叠层 刻蚀 填充 刻蚀阻挡层 制备 外延生长层 通孔结构 刻蚀选择比 三维存储器 基底结构 氧化层 去除 连通 阻挡 覆盖 | ||
【主权项】:
1.一种通孔结构的制备方法,其特征在于,所述方法包括:/n提供基底结构,所述基底结构包括第一堆叠层;/n刻蚀所述第一堆叠层,形成第一通孔;/n在所述第一通孔底部形成外延生长层;/n在所述第一通孔内形成刻蚀阻挡层,所述刻蚀阻挡层至少覆盖所述外延生长层的表面;/n在所述第一通孔内形成填充结构;/n在所述第一堆叠层上形成第二堆叠层;/n刻蚀所述第二堆叠层,形成连通所述第一通孔的第二通孔;/n刻蚀以去除所述第一通孔内的所述填充结构;/n其中,所述刻蚀阻挡层的材料与以下任意之一的材料之间的刻蚀选择比满足刻蚀阻挡要求:所述第二堆叠层、所述填充结构、所述填充结构的氧化层。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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