[发明专利]一种工艺浮动容忍的读取时序生成装置有效
申请号: | 201910351025.9 | 申请日: | 2019-04-28 |
公开(公告)号: | CN110060713B | 公开(公告)日: | 2021-10-22 |
发明(设计)人: | 陈巍巍;陈岚;尤云霞 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | G11C7/06 | 分类号: | G11C7/06;G11C7/10;G11C7/18 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 钱湾湾;王宝筠 |
地址: | 100029 北京市朝阳*** | 国省代码: | 北京;11 |
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摘要: | 本申请公开了一种读取时序生成装置,包括:被读取单元输出灵敏放大器和N个被读取单元单列结构,每个被读取单元单列结构具有预充电端、字线端和控制端,预充电端用于为所述被读取单元单列结构的位线充电,字线端用于选择被被读取单元,所述控制端用于控制输出所述被读取单元单列结构的位线信号;所述N个被读取单元单列结构的输出位线连接,所述被读取单元输出灵敏放大器读取所述N个被读取单元单列结构放电产生的平均电流作为读取时序。该装置通过利用N个被读取单元单列结构中的多个被读取单元产生读取时序,减小了工艺浮动对读取时序的影响,并使得读取时序逼近读取所需的时间,减少了读取时间的浪费,同时也减小了存储器的读取功耗。 | ||
搜索关键词: | 一种 工艺 浮动 容忍 读取 时序 生成 装置 | ||
【主权项】:
1.一种读取时序生成装置,其特征在于,所述装置包括:被读取单元输出灵敏放大器和N个被读取单元单列结构,N为大于1的正整数;每个所述被读取单元单列结构具有预充电端、字线端和控制端,所述预充电端用于为所述被读取单元单列结构的位线充电,所述字线端用于选择所述被读取单元单列结构中的被读取单元,所述控制端用于控制输出所述被读取单元单列结构的位线信号;所述N个被读取单元单列结构的输出位线连接;所述被读取单元输出灵敏放大器用于读取所述N个被读取单元单列结构进行放电产生的平均电流作为读取时序。
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