[实用新型]一种支持二次开发的串/并转化的接口处理板卡有效
| 申请号： | 201822179311.5 | 申请日： | 2018-12-24 |
| 公开（公告）号： | CN209265223U | 公开（公告）日： | 2019-08-16 |
| 发明（设计）人： | 黄振;王斌龙 | 申请（专利权）人： | 中国电子科技集团公司第二十研究所 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 西北工业大学专利中心 61204 | 代理人： | 顾潮琪 |
| 地址： | 710068 *** | 国省代码： | 陕西;61 |
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| 摘要： | 本实用新型提供了一种支持二次开发的串/并转化的接口处理板卡，LVDS收/发器与FPGA的I/O管脚连接，Flash存贮芯片的串行数据管脚、时钟管脚、片选管脚分别与FPGA芯片管脚连接，时钟及时钟驱动芯片，时钟输出管脚与时钟驱动芯片输入管脚连接，时钟驱动芯片输出与FPGA时钟芯片连接，电源转换芯片输入电压端与功能模块的直流电源相连，接口电平转换芯片的LVTTL信号管脚与FPGA的I/O连接，TTL信号管脚与连接器连接，监测复位芯片的检测管脚分别和电源转换芯片的输出电压管脚连接。本实用新型简化级联关系，易于理解和工程实现，能够实现用户不同的异步串行传输协议，可以广泛应用于各类数据链端机。 | ||
| 搜索关键词： | 管脚连接 电源转换芯片 本实用新型 接口处理板 二次开发 时钟驱动 管脚 接口电平转换芯片 数据链 时钟输出管脚 异步串行传输 直流电源相连 连接器连接 输入电压端 串行数据 存贮芯片 复位芯片 工程实现 级联关系 片选管脚 驱动芯片 时钟管脚 输出电压 芯片连接 芯片输入 信号管脚 检测管 端机 发器 转化 芯片 输出 监测 应用 | ||
【主权项】：
1.一种支持二次开发的串/并转化的接口处理板卡，包括现场可编程阵列FPGA、LVDS收/发器、Flash存贮芯片、时钟驱动芯片、电源转换芯片、接口电平转换芯片和监测复位芯片，其特征在于：所述的LVDS收/发器的单端管脚与FPGA的I/O管脚连接，用于串行数据接入/输出FPGA，LVDS收/发器的差分端管脚用于接通功能模块的差分输出/输入；所述Flash存贮芯片的串行数据管脚、时钟管脚、片选管脚分别与FPGA芯片相应的管脚连接，用于存储和加载用户二次开发协议；所述的时钟及时钟驱动芯片，时钟输出管脚与时钟驱动芯片输入管脚连接，时钟驱动芯片输出与FPGA时钟芯片连接，用于FPGA时钟源接入；所述的电源转换芯片，输入电压端与功能模块的直流电源相连，变换电压后输出DC1.2V、DC2.5V、DC3.3V的电压与FPGA芯片、LVDS收/发器、时钟及时钟驱动芯片、Flash存贮芯片、接口电平转换芯片、监测复位芯片的相应的管脚连接；所述的接口电平转换芯片的LVTTL信号管脚与FPGA的I/O连接，TTL信号管脚与连接器连接，用于FPGA芯片到接口的信号电平转换；所述的监测复位芯片的检测管脚分别和电源转换芯片的输出电压管脚连接，用于监测电源供电情况。
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