[实用新型]模拟BBU基带信号发生器和采集器有效
| 申请号： | 201821635923.4 | 申请日： | 2018-10-09 |
| 公开（公告）号： | CN208862847U | 公开（公告）日： | 2019-05-14 |
| 发明（设计）人： | 唐东升;王冉 | 申请（专利权）人： | 武汉正维电子技术有限公司 |
| 主分类号： | H04B17/00 | 分类号： | H04B17/00 |
| 代理公司： | 湖北武汉永嘉专利代理有限公司 42102 | 代理人： | 许美红 |
| 地址： | 430074 湖北省武*** | 国省代码： | 湖北;42 |
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| 摘要： | 本实用新型公开了一种模拟BBU基带信号发生器和采集器，包括：CPU最小系统，其包括集成CPU、DDR存储器、网口和串口；CPRI模块，通过光口与外部的射频拉远单元RRU连接；CPRI模块还通过CPU通用总线与所述CPU连接；第1双口RAM模块，与所述CPRI模块连接，并与所述CPU连接，还通过数字累加器和所述CPU通用总线连接；第2双口RAM模块，与CPRI模块连接，并与CPU连接，还通过所述数字累加器和CPU通用总线连接；TRIGGER IN接头，与同步电路连接，将板外触发信号接入；TRIGGER OUT接头，与所述同步电路连接，将同步信号引出；同步电路，与各个模块均连接。 | ||
| 搜索关键词： | 通用总线 同步电路 基带信号发生器 双口RAM模块 数字累加器 模块连接 采集器 串口 射频拉远单元 本实用新型 外触发信号 同步信号 光口 网口 外部 | ||
【主权项】：
1.一种模拟BBU基带信号发生器和采集器，其特征在于,包含CPRI模块、第1双口RAM模块、第2双口RAM模块、数字累加器、 CPU最小系统、TRIGGER IN接头、TRIGGER OUT接头和同步电路；所述CPU最小系统，包括集成CPU、 DDR存储器、网口和串口；所述CPRI模块，通过光口与外部的射频拉远单元RRU连接；所述CPRI模块还通过CPU通用总线与所述集成CPU连接；所述第1双口RAM模块，与所述CPRI模块连接，并与所述集成CPU连接，还通过所述数字累加器和所述CPU通用总线连接；所述第2双口RAM模块，与所述CPRI模块连接，并与所述集成CPU连接，还通过所述数字累加器和所述CPU通用总线连接；所述TRIGGER IN接头，与所述同步电路连接，将板外触发信号接入；所述TRIGGER OUT接头，与所述同步电路连接，将同步信号引出；所述同步电路，与各个模块均连接。
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