[实用新型]一种基于FPGA芯片的加密装置有效
| 申请号： | 201820541784.2 | 申请日： | 2018-04-17 |
| 公开（公告）号： | CN208028910U | 公开（公告）日： | 2018-10-30 |
| 发明（设计）人： | 王国栋;王乐井;何禹涛;汤建峰 | 申请（专利权）人： | 深圳市华讯方舟雷达技术装备有限公司 |
| 主分类号： | H04L9/06 | 分类号： | H04L9/06 |
| 代理公司： | 深圳市中联专利代理有限公司 44274 | 代理人： | 李俊 |
| 地址： | 518000 广东省深圳市南山区粤*** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型公开了一种基于FPGA芯片的加密装置，包括：基于FLASH工艺的FPGA芯片，带有FLASH LOCK和AES加密功能；FPGA芯片内部设有信号处理模块、内部RAM、AES模块，内部RAM连接信号处理模块，AES模块连接内部RAM；信号处理模块对外部信号进行处理后存入内部RAM；AES模块包括AES加密模块和AES解密模块，内部数据经过AES加密模块进行AES加密后才能输出，外部数据经过AES解密模块解密后才能输入。本实用新型的有益效果是，采用基于FLASH工艺的FPGA方案，无需外接配置芯片，即可实现高可靠性的设计；设计安全性高，程序不会因外部接口被复制。 | ||
| 搜索关键词： | 信号处理模块 本实用新型 加密装置 解密模块 信号进行处理 高可靠性 内部数据 配置芯片 外部接口 外部数据 解密 外接 复制 输出 外部 | ||
【主权项】：
1.一种基于FPGA芯片的加密装置，其特征在于，包括：基于FLASH工艺的FPGA芯片，带有FLASH LOCK和AES加密功能；所述FPGA芯片内部设有信号处理模块、内部RAM、AES模块，所述内部RAM连接所述信号处理模块，所述AES模块连接所述内部RAM；所述信号处理模块对外部信号进行处理后并存入所述内部RAM；所述AES模块包括AES加密模块和AES解密模块，内部数据经过所述AES加密模块进行AES加密后才能输出，外部数据经过所述AES解密模块解密后才能输入。
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