[发明专利]一种基于时钟的双速流水线架构微处理器及其实现方法有效
申请号: | 201811508771.6 | 申请日: | 2018-12-11 |
公开(公告)号: | CN109634667B | 公开(公告)日: | 2023-03-14 |
发明(设计)人: | 王爽;牛英山;唐虹 | 申请(专利权)人: | 中国电子科技集团公司第四十七研究所 |
主分类号: | G06F9/38 | 分类号: | G06F9/38 |
代理公司: | 沈阳科苑专利商标代理有限公司 21002 | 代理人: | 王倩 |
地址: | 110032 辽*** | 国省代码: | 辽宁;21 |
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摘要: | 本发明涉及一种基于时钟的双速流水线架构微处理器及其实现方法,根据指令标识的要求,选择高速流水线或者低速流水线执行指令。利用单个处理器资源,设计实现一种工作在不同速度下的双速流水线架构。高速流水线处理的高性能与低速流水线处理的低功耗相结合,可以在提高微处理器系统处理能力的同时,最大程度的降低系统功耗。满足嵌入式微处理器应用领域的高性能与低功耗的要求,同时双速流水线架构的微处理器在功耗方面的表现较大小端双核微处理器系统会更加优秀。 | ||
搜索关键词: | 一种 基于 时钟 流水线 架构 微处理器 及其 实现 方法 | ||
【主权项】:
1.一种基于时钟的双速流水线架构微处理器实现方法,其特征在于:根据指令标识的要求,选择高速流水线或者低速流水线执行指令,包括以下步骤:取指级通过向外部程序存储器取指后,将取到的指令送至译码级;译码级接收到指令后对指令进行译码,同时将译码后的指令发送至发射极;发射级对指令进行判断,判断当前的指令是高速处理指令还是低速处理指令;如是高速处理指令,则发射到高速流水线;若是低速处理指令,则发射到低速流水线,同时发射级将指令信息发送至时钟分频模块;时钟分频模块根据指令信息将高速时钟进行分频,得到低速时钟作为低速流水线的工作时钟。
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