[发明专利]一种嵌入式闪存结构的形成方法有效
| 申请号: | 201811198894.4 | 申请日: | 2018-10-15 |
| 公开(公告)号: | CN109524406B | 公开(公告)日: | 2021-03-02 |
| 发明(设计)人: | 江红;王哲献 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
| 主分类号: | H01L27/11521 | 分类号: | H01L27/11521;H01L27/11531 |
| 代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 屈蘅 |
| 地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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| 摘要: | 本发明涉及一种嵌入式闪存结构的形成方法,包括以下步骤:提供衬底,衬底上包括存储区和逻辑区;在存储区和逻辑区沉积第一浮栅堆叠层,第一浮栅堆叠层包括依次沉积的隧穿氧化层、第一浮栅层和第一掩膜层;同时去除存储区和逻辑区的第一掩膜层;在存储区和逻辑区沉积第二浮栅堆叠层;去除逻辑区上隧穿氧化层以上的所有沉积层;沉积第二掩膜层至存储区和逻辑区;在存储区的第二掩膜层中形成凹槽,在凹槽内形成闪存器件结构。本申请中通过采用一次湿法刻蚀就同时去除存储区和逻辑区的第二掩膜层,减少了去除所述逻辑区所有沉积层所使用的光刻步骤。本发明减少了嵌入式闪存结构的形成方法的工艺步骤,也节约了成本。 | ||
| 搜索关键词: | 一种 嵌入式 闪存 结构 形成 方法 | ||
【主权项】:
1.一种嵌入式闪存结构的形成方法,其特征在于,包括以下步骤:提供衬底,所述衬底上包括存储区和逻辑区;在所述存储区和所述逻辑区沉积第一浮栅堆叠层,所述第一浮栅堆叠层包括依次沉积的隧穿氧化层、第一浮栅层和第一掩膜层;同时去除所述存储区和所述逻辑区的第一掩膜层;在所述存储区和所述逻辑区沉积第二浮栅堆叠层;去除所述逻辑区所述隧穿氧化层以上的所有沉积层;沉积第二掩膜层至所述存储区和所述逻辑区;在所述存储区的第二掩膜层中形成凹槽,在所述凹槽内形成闪存器件结构。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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