[发明专利]一种信号采集处理器及其多数据量读取方法在审
| 申请号： | 201811050340.X | 申请日： | 2018-09-10 |
| 公开（公告）号： | CN109375532A | 公开（公告）日： | 2019-02-22 |
| 发明（设计）人： | 赖龙伟;冷用斌;阎映炳 | 申请（专利权）人： | 中国科学院上海应用物理研究所 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 上海智信专利代理有限公司 31002 | 代理人： | 邓琪 |
| 地址： | 201800 上*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明提供了一种信号采集处理器，其包括一FPGA和一CPU，FPGA包括数据处理器；FPGA还包括触发计数器和寄存器，数据处理器和触发计数器的输入端与同一触发信号相连，触发计数器的输出端与CPU相连；寄存器的输入端与数据处理器的输出端相连，其输出端与CPU相连。本发明的信号采集处理器通过FPGA的数据处理器可保证在触发周期内对每组触发的数据进行处理，并通过寄存器的设置使得处理器能够判断处理结果数据是否更新并按顺序读取不同组的处理结果数据；同时信号采集处理器上设置有触发计数器，保证了对所有触发进行记录并打上触发计数值，进而可通过触发计数值发现数据丢失。 | ||
| 搜索关键词： | 触发 信号采集处理器 计数器 数据处理器 寄存器 输出端 输入端 读取 输出端相连 触发信号 结果数据 判断处理 数据丢失 顺序读取 数据量 处理器 保证 更新 记录 发现 | ||
【主权项】：
1.一种信号采集处理器，其包括一FPGA(1)和一CPU(2)，FPGA(1)包括数据处理器(11)，数据处理器(11)的输入端通过ADC与多个模拟信号输入通道相连，其输出端与CPU(2)相连；其特征在于，所述FPGA(1)还包括触发计数器(12)和寄存器(13)，其中，数据处理器(11)和触发计数器(12)的输入端与同一触发信号相连，触发计数器(12)的输出端与CPU(2)相连；寄存器(13)的输入端与数据处理器(11)的输出端相连，其输出端与CPU(2)相连。
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