[发明专利]GOA电路及具有该GOA电路的HG2D像素结构在审
| 申请号： | 201810878457.0 | 申请日： | 2018-08-03 |
| 公开（公告）号： | CN109003587A | 公开（公告）日： | 2018-12-14 |
| 发明（设计）人： | 吕晓文;陈书志 | 申请（专利权）人： | 深圳市华星光电半导体显示技术有限公司 |
| 主分类号： | G09G3/36 | 分类号： | G09G3/36 |
| 代理公司： | 深圳翼盛智成知识产权事务所(普通合伙) 44300 | 代理人： | 黄威 |
| 地址： | 518132 广东省深*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种具有该GOA电路的HG2D像素结构，所述GOA电路包括母线单元和多个联级的GOA驱动单元，所述母线单元中排列有奇数条CK时钟信号线，每一所述GOA驱动单元连接一CK时钟信号线；每一所述CK时钟信号线的CK信号占空比设置为Duty(100/N)/(100/N)。本发明可以有效的减少了CK时钟信号线的条数，其在应用在HG2D像素结构时，使用奇数条数的CK时钟信号线，就可以使用一些中间CK时钟信号线的数目，如6CK,10CK,CK时钟信号线的数目以2的倍数倍增，可以更好的利用空间，能够合理的安排电路布线，节省了电路布线空间。 | ||
| 搜索关键词： | 时钟信号线 像素结构 电路布线 母线单元 驱动单元 条数 信号占空比 倍增 应用 | ||
【主权项】：
1.一种GOA电路，其特征在于，包括母线单元和多个联级的GOA驱动单元，所述母线单元中排列有奇数条CK时钟信号线，每一所述GOA驱动单元连接一CK时钟信号线；每一所述CK时钟信号线的CK信号占空比设置为Duty(100/N)/(100/N)。
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