[发明专利]双面电容器结构及其制备方法在审
申请号: | 201810676961.2 | 申请日: | 2018-06-27 |
公开(公告)号: | CN108717936A | 公开(公告)日: | 2018-10-30 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 长鑫存储技术有限公司 |
主分类号: | H01L21/8242 | 分类号: | H01L21/8242;H01L27/108;H01L23/64 |
代理公司: | 上海光华专利事务所(普通合伙) 31219 | 代理人: | 余明伟 |
地址: | 230000 安徽省合肥市*** | 国省代码: | 安徽;34 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明提供一种双面电容器结构的制备方法,该方法包括:1)提供一半导体衬底,于半导体衬底上形成叠层结构,2)于叠层结构上形成图形化掩膜层,基于图形化掩膜层于叠层结构中刻蚀出多个电容孔;3)于电容孔的底部及侧壁形成下电极层;4)于步骤3)得到的结构上形成掩膜层,基于掩膜层于叠层结构上形成掩膜开口,开口暴露出电容孔的20%~60%内孔径面积,基于掩膜开口,去除牺牲层;5)于下电极层的内表面及外表面形成电容介质层,于电容介质层的外表面形成上电极层。本发明采用不同的开孔方式,通过控制电容开孔面积及使用支撑层刻蚀气体源,从而形成密度更密,机械强度更强且可保证电容值的双面电容器。 | ||
搜索关键词: | 叠层结构 电容 图形化掩膜层 电容介质层 电容器结构 开口 下电极层 掩膜层 衬底 开孔 面形 掩膜 制备 半导体 电容器 多个电容 刻蚀气体 控制电容 电极层 内表面 内孔径 牺牲层 支撑层 侧壁 刻蚀 去除 暴露 保证 | ||
【主权项】:
1.一种双面电容器结构的制备方法,其特征在于,所述双面电容器结构的制备方法至少包括如下步骤:1)提供一半导体衬底,于所述半导体衬底上形成叠层结构,所述叠层结构包括交替层叠的支撑层及牺牲层;2)于所述叠层结构上形成图形化掩膜层,基于所述图形化掩膜层于所述叠层结构中刻蚀出多个电容孔;3)于所述电容孔的底部及侧壁形成下电极层,所述支撑层连接所述下电极层;4)于步骤3)得到的结构上形成掩膜层,基于所述掩膜层于所述叠层结构上形成掩膜开口,其中,所述掩膜开口暴露出所述电容孔的20%~60%内孔径面积;并且基于所述掩膜开口,去除所述牺牲层及所述掩膜开口内且交替层叠在所述牺牲层上的所述支撑层,其中位于底层的所述支撑层保留在所述半导体衬底上;5)于所述下电极层的内表面及外表面形成电容介质层,其中,所述电容介质层覆盖所述下电极层,并于所述电容介质层的外表面形成上电极层,其中所述上电极层覆盖所述电容介质层及所述支撑层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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