[发明专利]用于加速多核计算架构中的图形工作负荷的机制在审
| 申请号： | 201780042066.9 | 申请日： | 2017-07-12 |
| 公开（公告）号： | CN109923519A | 公开（公告）日： | 2019-06-21 |
| 发明（设计）人： | C·本廷;S·沃普;I·沃德 | 申请（专利权）人： | 英特尔IP公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30;G06F9/50 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 黄嵩泉;张欣 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 描述了一种处理装置。该装置包括：多个处理核，该多个处理核包括第一处理核和第二处理核；第一现场可编程门阵列(FPGA)，耦合至第一处理核，以加速在该第一处理核处被处理的图形工作负荷的执行；以及第二FPGA，耦合至第二处理核，以加速在该第二处理核处被处理的工作负荷的执行。 | ||
| 搜索关键词： | 处理核 工作负荷 耦合 现场可编程门阵列 处理装置 多核 架构 | ||
【主权项】：
1.一种处理装置，包括：多个处理核，所述多个处理核包括：第一处理核；以及第二处理核；第一现场可编程门阵列(FPGA)，耦合至所述第一处理核，以加速在所述第一处理核处被处理的工作负荷的执行；以及第二FPGA，耦合至所述第二处理核，以加速在所述第二处理核处被处理的工作负荷的执行。
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