[发明专利]数据处理系统在审

专利信息
申请号: 201710824587.1 申请日: 2013-02-05
公开(公告)号: CN107612548A 公开(公告)日: 2018-01-19
发明(设计)人: 川上史树;矢田直树;纲川裕之 申请(专利权)人: 瑞萨电子株式会社
主分类号: H03M1/12 分类号: H03M1/12
代理公司: 中国国际贸易促进委员会专利商标事务所11038 代理人: 肖靖
地址: 日本*** 国省代码: 暂无信息
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摘要: 发明涉及一种数据处理系统。设置多个模拟端口(AN0~AN3);A/D变换部(118),能够对每个预先设定的假想通道执行用于将经上述模拟端口取入的模拟信号变换成数字信号的A/D变换处理;A/D变换控制部(125),控制上述A/D变换部的动作。上述A/D变换控制部包含假想通道寄存器,能够设定上述假想通道与上述模拟端口的对应关系;扫描组形成用寄存器,能够设定扫描组的开始位置和结束位置。上述A/D变换控制部连续地执行关于从与上述开始指针对应的假想通道到与上述结束指针对应的假想通道的多个假想通道的A/D变换处理。
搜索关键词: 数据处理系统
【主权项】:
一种数据处理系统,包括:第1模拟端口,适于接收第1模拟信号和第2模拟信号;第2模拟端口,适于接收第3模拟信号;第1寄存器,存储用于第1模拟端口的第1延迟信息和用于第2模拟端口的第2延迟信息;第2寄存器,存储指针信息以选择所述第1模拟端口和第2模拟端口中的一个;以及A/D变换部,在基于与选择出的模拟端口对应的延迟信息的值的延迟之后将选择出的模拟端口的值变换为数字值,其中,所述第1延迟信息包括第1延迟值,所述第2延迟信息包括第2延迟值,所述第1延迟值大于所述第2延迟值。
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