[发明专利]全数字锁相回路ADPLL电路在审
| 申请号： | 201710664138.5 | 申请日： | 2017-08-04 |
| 公开（公告）号： | CN108073068A | 公开（公告）日： | 2018-05-25 |
| 发明（设计）人： | 郭丰维;周淳朴;卓联洲;陈焕能;罗伯特·B·史塔兹斯基;希尔登瑟·博罗马西恩 | 申请（专利权）人： | 台湾积体电路制造股份有限公司 |
| 主分类号： | G04F10/00 | 分类号： | G04F10/00;H03L7/18 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 路勇 |
| 地址： | 中国台湾新竹市*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明实施例涉及一种全数字锁相回路ADPLL电路，其包括：时间/数字转换器TDC，其经配置以产生指示第一信号与参考信号之间的相位差的信号；及倍频器，其电耦合到所述TDC。所述倍频器经配置以接收第一电压信号且产生第二电压信号。将所述第二电压信号提供到所述TDC的电压输入。所述TDC经配置以产生供所述倍频器调整所述第二电压信号的一或多个控制信号。 | ||
| 搜索关键词： | 电压信号 倍频器 全数字锁相回路 配置 时间/数字转换器 电压输入 控制信号 电耦合 相位差 | ||
【主权项】：
1.一种电路，其包含：时间/数字转换器TDC，其经配置以产生指示第一信号与参考信号之间的相位差的信号；及倍频器，其电耦合到所述TDC，其中所述倍频器经配置以接收第一电压信号且产生第二电压信号，其中将所述第二电压信号提供到所述TDC的电压输入，且其中所述TDC产生经配置以产生调整所述第二电压信号的一或多个控制信号。
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