[发明专利]输入输出设备的访问方法及装置在审
| 申请号： | 201710449008.X | 申请日： | 2017-06-14 |
| 公开（公告）号： | CN109086231A | 公开（公告）日： | 2018-12-25 |
| 发明（设计）人： | 张爽爽;高翔 | 申请（专利权）人： | 龙芯中科技术有限公司 |
| 主分类号： | G06F13/20 | 分类号： | G06F13/20;G06F13/40 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 宋扬;刘芳 |
| 地址： | 100095 北京市海淀*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供的输入输出设备的访问方法及装置，通过接收并根据处理器核心发出的IO访问操作的目标地址，按照预设的多种判定逻辑中确定IO访问操作命中的判定逻辑，根据命中的判定逻辑所对应的寄存器组的预设属性位确定IO访问操作的类型。当确定IO访问操作为可加速写操作时，将IO访问操作写入缓冲列表，并向处理器核心反馈IO访问操作的写成功信号；当确定IO访问操作为可加速读操作时，向IO设备发送包括目标地址的第一读取请求以及目标地址的后续地址的第二读取请求，并接收IO设备返回的第一数据和第二数据；将第一数据发送至处理器核心，将第二数据存入数据缓冲区，从而提高了IO设备的读操作和写操作的速度，进而提高了访问效率。 | ||
| 搜索关键词： | 处理器核心 目标地址 输入输出设备 判定 第一数据 读取请求 读操作 写操作 预设 数据存入数据 发送 成功信号 访问效率 后续地址 寄存器组 写入缓冲 缓冲区 访问 反馈 返回 | ||
【主权项】：
1.一种输入输出设备的访问方法，其特征在于,包括：接收处理器核心发出的IO访问操作；根据所述IO访问操作的目标地址，在预设的多种判定逻辑中确定IO访问操作命中的判定逻辑；根据所述命中的判定逻辑所对应的寄存器组的预设属性位确定IO访问操作的类型；当确定所述IO访问操作为可加速写操作时，将所述IO访问操作写入缓冲列表，并向所述处理器核心反馈IO访问操作的写成功信号；当确定所述IO访问操作为可加速读操作时，向IO设备发送包括所述目标地址的第一读取请求以及包括所述目标地址的后续地址的第二读取请求，并接收所述IO设备根据所述第一读取请求返回的第一数据和所述IO设备根据所述第二读取请求返回的第二数据；将所述第一数据发送至处理器核心，将所述第二数据存入数据缓冲区。
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