[发明专利]一种基于心动阵列的有限域乘法装置有效

专利信息
申请号: 201710168823.9 申请日: 2017-03-21
公开(公告)号: CN106951210B 公开(公告)日: 2020-09-29
发明(设计)人: 易海博;聂哲 申请(专利权)人: 深圳职业技术学院
主分类号: G06F7/52 分类号: G06F7/52
代理公司: 深圳精智联合知识产权代理有限公司 44393 代理人: 夏声平
地址: 518055*** 国省代码: 广东;44
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摘要: 发明提出一种基于心动阵列的有限域乘法装置,包括:输入端口,用于输入有限域的运算数、有限域的子域上选定的第一既约多项式、有限域上选定的第二既约多项式以及时钟信号;子域乘法器,用于调用乘法心动阵列执行运算数在所述子域上的乘法;子域加法器,用于调用加法心动阵列执行运算数在所述子域上的加法;控制器,与输入端口、子域乘法器和子域加法器分别相连接,用于解析时钟信号、调用子域乘法器和子域加法器、并执行有限域上的运算数的乘法;以及输出端口,连接控制器,用于输出有限域上的运算数的乘法的运算结果。本发明基于心动阵列可以提高乘法效率。
搜索关键词: 一种 基于 心动 阵列 有限 乘法 装置
【主权项】:
一种基于心动阵列的有限域乘法装置,其特征在于,包括:输入端口,用于输入有限域的第一运算数和第二运算数、所述有限域的子域上选定的第一既约多项式、所述有限域上选定的第二既约多项式以及时钟信号;子域乘法器,用于调用乘法心动阵列执行所述第一运算数和所述第二运算数在所述子域上的乘法;子域加法器,用于调用加法心动阵列执行所述第一运算数和所述第二运算数在所述子域上的加法;控制器,与所述输入端口、所述子域乘法器和所述子域加法器分别相连接,用于解析所述时钟信号、调用所述子域乘法器和所述子域加法器、并执行所述有限域上的所述第一运算数和所述第二运算数的乘法;以及输出端口,连接所述控制器,用于输出所述有限域上的所述第一运算数和所述第二运算数的乘法的运算结果。
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