[发明专利]存储器单元、半导体集成电路装置及半导体集成电路装置的制造方法有效
| 申请号: | 201680023931.0 | 申请日: | 2016-04-26 |
| 公开(公告)号: | CN107533980B | 公开(公告)日: | 2019-07-09 |
| 发明(设计)人: | 大和田福夫;川嶋泰彦;吉田信司;谷口泰弘;奥山幸祐 | 申请(专利权)人: | 株式会社佛罗迪亚 |
| 主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L27/10;H01L27/11521;H01L27/11568;H01L29/788;H01L29/792 |
| 代理公司: | 北京海智友知识产权代理事务所(普通合伙) 11455 | 代理人: | 吴京顺 |
| 地址: | 日本国*** | 国省代码: | 日本;JP |
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| 摘要: | 本发明提供半导体集成电路装置及半导体集成电路装置的制造方法中,其中,将第一选择栅极(DG)和第二选择栅极(SG)沿着存储器栅极构造体(4)的侧壁以侧墙状形成,因此存储器栅极构造体(4)不会搭乘在第一选择栅极(DG)和第二选择栅极(SG)上,从而能够使存储器栅极构造体(4)、第一选择栅极构造体(5)及第二选择栅极构造体(6)的高度一致,相应地与现有技术相比能够实现小型化,另外,能够使第一选择栅极(DG)上的硅化物层(S1)、第二选择栅极(SG)上的硅化物层(S2)从储存器栅极(MG)疏远相当于盖膜(CP1)的膜厚度,因此相对于存储器栅极(MG),第一选择栅极(DG)上和第二选择栅极(SG)上的硅化物层(S1、S2)难以接触,相应地能够防止存储器栅极(MG)的短路不良。 | ||
| 搜索关键词: | 存储器 单元 半导体 集成电路 装置 制造 方法 | ||
【主权项】:
1.一种半导体集成电路装置,所述半导体集成电路装置具有存储器电路区域和周边电路区域,其特征在于,在所述存储器电路区域,设置有连接有位线和源极线的存储器单元以矩阵状配置的存储器单元区域,和存储器栅极连接器区域,所述存储器单元包括:漏极区域,形成在存储器阱表面,与所述位线连接;源极区域,形成在所述存储器阱表面,与所述源极线连接;存储器栅极构造体,形成在所述漏极区域与所述源极区域之间,并以下部存储器栅极绝缘膜、电荷存储层、上部存储器栅极绝缘膜、存储器栅极及由绝缘部件构成的盖膜的顺序层叠而形成在所述存储器阱上;第一选择栅极构造体,在所述漏极区域与所述存储器栅极构造体之间的所述存储器阱上夹着第一选择栅极绝缘膜形成有第一选择栅极,且与所述存储器栅极构造体的一侧壁夹着一侧壁隔板而邻接;及第二选择栅极构造体,在所述源极区域与所述存储器栅极构造体之间的所述存储器阱上夹着第二选择栅极绝缘膜形成有第二选择栅极,且与所述存储器栅极构造体的另一侧壁夹着另一侧壁隔板而邻接,所述第一选择栅极具有相对于所述一侧壁隔板以侧墙状形成且在其上表面部形成有硅化物层的结构,所述第二选择栅极具有相对于所述另一侧壁隔板以侧墙状形成且在其上表面部形成有硅化物层的结构,在所述存储器栅极连接器区域中,延伸设置有在所述存储器单元区域形成的所述存储器栅极,而没有延伸设置有所述第一选择栅极和所述第二选择栅极,在所述存储器栅极连接器区域中,在所述存储器栅极没有设置有所述盖膜,在所述存储器栅极上竖立设置有存储器栅极连接器。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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