[实用新型]一种通过FPGA内部延时模块测量两路信号时间差的装置有效
| 申请号： | 201520004511.0 | 申请日： | 2015-01-06 |
| 公开（公告）号： | CN204347454U | 公开（公告）日： | 2015-05-20 |
| 发明（设计）人： | 周柔刚;周才健;纪善昌 | 申请（专利权）人： | 杭州汇萃智能科技有限公司 |
| 主分类号： | G04F10/00 | 分类号： | G04F10/00 |
| 代理公司： | 杭州华知专利事务所 33235 | 代理人： | 龙湖浩 |
| 地址： | 311121 浙江省杭州市余*** | 国省代码： | 浙江;33 |
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| 摘要： | 本实用新型包括锁存器和若干延时模块，所述的延时模块依次串联，所述的任一延时模块的输入端与锁存器的输入端相连。本实用新型提供一种结构简单，调试方便，误差偏移小，性能稳定，集成度高的一种通过FPGA内部延时模块精密测量两路信号时间差的装置。 | ||
| 搜索关键词： | 一种 通过 fpga 内部 延时 模块 测量 信号 时间差 装置 | ||
【主权项】：
一种通过FPGA内部延时模块测量两路信号时间差的装置，其特征在于： 包括锁存器（1）和若干延时模块（2），所述的延时模块（2）依次串联，所述的任一延时模块（2）的输入端与锁存器（1）的输入端相连。
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