[发明专利]一种ASIC设计时钟网络提取系统有效
| 申请号： | 201511005377.7 | 申请日： | 2015-12-29 |
| 公开（公告）号： | CN105550459B | 公开（公告）日： | 2019-03-19 |
| 发明（设计）人： | 唐涛;石广;刘海林;王硕 | 申请（专利权）人： | 山东海量信息技术研究院 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 济南信达专利事务所有限公司 37100 | 代理人： | 姜明 |
| 地址： | 250101 山东省济南*** | 国省代码： | 山东;37 |
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| 摘要： | 本发明公开一种ASIC设计时钟网络提取系统,涉及芯片设计领域，该系统基于EDA工具，通过TCL脚本实现的分析算法完成ASIC设计中大规模复杂时钟网络的分析和提取任务；该系统由三部分组成：时钟模式分析单元、时钟域分析单元、原始时钟网络输出单元。应用本发明，高度自动化地完成ASIC设计时钟网络的分析和提取，可以大幅度降低传统通过人工分析方法带来的差错率，同时也能极大地提高工作效率。 | ||
| 搜索关键词： | 一种 asic 设计 时钟 网络 提取 系统 | ||
【主权项】：
1.一种ASIC设计时钟网络提取系统，其特征在于,基于EDA工具，通过TCL脚本实现的分析算法完成ASIC设计中大规模复杂时钟网络的分析和提取任务；该系统由三部分组成：时钟模式分析单元、时钟域分析单元、原始时钟网络输出单元；所述时钟模式分析单元，根据输入的模式约束文件产生ASIC设计在不同工作模式下用于时钟网络分析的参数，并传递给时钟域分析单元；所述时钟域分析单元，根据时钟模式分析单元产生的参数，分析ASIC设计分别在不同工作模式下各时钟域及整体时钟网络多方面指标信息，包括叶结点个数、叶结点门控时钟个数、骨干门控时钟单元路径名称及类型、存储体及IP核单元路径名称、时钟产生模块路径名称；所述原始时钟网络输出单元，综合时钟域分析单元提取的时钟网络指标信息，产生输出文档。
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