[发明专利]一种应用于SERDES接收端的连续时间线性自适应均衡器电路有效

专利信息
申请号: 201510709268.7 申请日: 2015-10-28
公开(公告)号: CN106656876B 公开(公告)日: 2019-07-09
发明(设计)人: 徐震;唐重林;项骏;刘寅 申请(专利权)人: 北京华大九天软件有限公司
主分类号: H04L25/03 分类号: H04L25/03;H03F3/45
代理公司: 暂无信息 代理人: 暂无信息
地址: 100102 北京*** 国省代码: 北京;11
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摘要: 发明公开了一种应用于SERDES接收端的连续时间线性自适应均衡器电路,如图1所示。输入差分信号首先通过增益级(Gain Stage)进行放大处理,再由Sampler电路对增益级的输出信号进行采样,采样信息输入到数字控制模块(Digital FSM),根据算法处理结果调整输出码Adapt_code<7:0>,Adapt_code<7:0>反馈输入到增益控制模块(Gain Control Module),增益控制模块动态产生控制电压(Control Voltage)调整增益级的增益实现对输入信号的再均衡。
搜索关键词: 一种 应用于 serdes 接收 连续 时间 线性 自适应 均衡器 电路
【主权项】:
1.一种应用于SERDES接收端的连续时间线性自适应均衡器电路,其特征在于:输入差分信号首先通过增益级(Gain Stage)进行放大处理,再由Sampler电路对增益级的输出信号进行采样,采样信息输入到数字控制模块(Digital FSM),根据算法处理结果调整输出码Adapt_code<7:0>,Adapt_code<7:0>反馈输入到增益控制模块(Gain Control Module),增益控制模块动态产生控制电压(Control Voltage)调整增益级的增益实现对输入信号的再均衡;所述增益级(Gain Stage)采用Cherry‑Hooper放大器结构,在M3和M4的源极之间增加以并联形式连接的简并电阻和简并电容,简并电阻使用可变电阻Rs,简并电容使用MOS管电容M5和M6,可以针对输入信号在规定频点处提供等间隔均匀分布的8档增益。
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