[发明专利]带跳转候选的双同步电子设备和FIFO存储器电路及相关方法有效
| 申请号： | 201510647202.X | 申请日： | 2015-10-08 |
| 公开（公告）号： | CN105487836B | 公开（公告）日： | 2019-08-20 |
| 发明（设计）人： | S·M·罗塞利;G·谷亚纳西亚;U·马里 | 申请（专利权）人： | 意法半导体股份有限公司 |
| 主分类号： | G06F5/06 | 分类号： | G06F5/06 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华 |
| 地址： | 意大利阿格*** | 国省代码： | 意大利;IT |
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| 摘要： | 本公开涉及带跳转候选的双同步电子设备和FIFO存储器电路及相关方法。一种双同步电子设备可以包括：FIFO存储器电路，以及第一数字电路，所述第一数字电路耦合至所述FIFO存储器电路并且配置成基于第一时钟信号操作，并且基于写指针对所述FIFO存储器电路进行写入。所述双同步电子设备可包括：第二数字电路，所述第二数字电路耦合至所述FIFO存储器电路并且配置成，基于与所述第一时钟信号不同的第二时钟信号操作，并且基于读指针从所述FIFO存储器电路进行读取。所述FIFO存储器电路可被配置成：检测所述写指针到新位置的跳转，根据当前位置确定所述读指针的跳转候选，选择跳转候选，并且基于所选择的跳转候选对所述读指针进行同步。 | ||
| 搜索关键词： | 跳转 候选 同步 电子设备 fifo 存储器 电路 相关 方法 | ||
【主权项】：
1.一种双同步电子设备，包括：先进先出FIFO存储器电路；第一数字电路，所述第一数字电路耦合至所述FIFO存储器电路并且配置成：基于第一时钟信号操作，以及基于写指针对所述FIFO存储器电路进行写入；以及第二数字电路，所述第二数字电路耦合至所述FIFO存储器电路并且配置成：基于与所述第一时钟信号不同的第二时钟信号操作，以及基于读指针从所述FIFO存储器电路进行读取；所述FIFO存储器电路配置成：检测所述写指针到新位置的跳转，根据当前位置确定所述读指针的多个跳转候选，从所述多个跳转候选选择一个跳转候选，以及基于所选择的跳转候选对所述读指针进行同步。
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