[发明专利]多通道抗干扰数字采样装置无效
| 申请号： | 201310018140.7 | 申请日： | 2013-01-17 |
| 公开（公告）号： | CN103078641A | 公开（公告）日： | 2013-05-01 |
| 发明（设计）人： | 赵铮 | 申请（专利权）人： | 陕西北斗恒通信息科技有限公司 |
| 主分类号： | H03M1/12 | 分类号： | H03M1/12 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 710065 陕西省西安市高新区科创路1*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明公开了多通道抗干扰数字采样装置，包括：一若干个多路并行的ADC构成的模数转换器组，以及与模数转换器组连通的FPGA，所述模数转换器组将多通道并行射频前端接收的多通道并行的模拟信号，转换为可供FPGA处理的数字信号，所述模数转换器组还连通一为ADC提供可调延迟的采样时钟信号的时钟芯片，所述时钟芯片的采样时钟信号分为多路并行输出给ADC芯片。该装置在16位ADC的基础上，采用超低抖动的采样时钟来达到其动态范围的最大化，同时一个多通道输出的延迟可变时钟芯片来保证每路采样时钟的一致性，装置灵活性高，结构简单，具有较高的同步性及较高的动态范围。 | ||
| 搜索关键词： | 通道 抗干扰 数字 采样 装置 | ||
【主权项】：
多通道抗干扰数字采样装置，其特征在于，包括：一若干个多路并行的ADC构成的模数转换器组，以及与模数转换器组连通的FPGA，所述模数转换器组将多通道并行射频前端接收的多通道并行的模拟信号，转换为可供FPGA处理的数字信号，所述模数转换器组还连通一为ADC提供可调延迟的采样时钟信号的时钟芯片，所述时钟芯片的采样时钟信号分为多路并行输出给ADC芯片。
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