[实用新型]一种SPI串口模块的FPGA实现装置有效

专利信息
申请号: 201220320399.8 申请日: 2012-07-04
公开(公告)号: CN202870808U 公开(公告)日: 2013-04-10
发明(设计)人: 王维维;昌畅 申请(专利权)人: 四川九洲电器集团有限责任公司
主分类号: G06F13/24 分类号: G06F13/24
代理公司: 成都九鼎天元知识产权代理有限公司 51214 代理人: 徐宏;吴彦峰
地址: 621000 四*** 国省代码: 四川;51
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摘要: 实用新型提供了一种SPI串口模块的FPGA实现装置,属于接口通信领域。该装置以FPGA为硬件平台,包括对外并行接口模块(1),数据接收FIFO模块(2),通信参数配置模块(3),数据发送FIFO模块(4),串行数据接收、命令解析及中断产生模块(5),串行时钟产生及收发控制模块(6),串行数据发送处理模块(7)。可实现对SPI通信数据的自动接收和发送,也可由外部对该SPI串口进行快速配置,从而完成串口通信速率、时钟模式、工作方式、数据长度等的动态更改。可扩充为多路SPI数据通信接口,一方面弥补了常规处理控制器件所自带的SPI硬件串口操作繁琐、功能受限的不足,另一方面也把单片机、DSP从频繁的数据查询或数据中断中解放出来,从而投入更多精力到其它的功能控制中。
搜索关键词: 一种 spi 串口 模块 fpga 实现 装置
【主权项】:
一种SPI串口模块的FPGA实现装置,其特征在于: 包括对外并行接口模块(1),数据接收FIFO模块(2),通信参数配置模块(3),数据发送FIFO模块(4),串行数据接收、命令解析及中断产生模块(5),串行时钟产生及收发控制模块(6),串行数据发送处理模块(7); 所述对外并行接口模块(1)分别与数据接收FIFO模块(2)、通信参数配置模块(3)、数据发送FIFO模块(4)相连; 所述数据接收FIFO模块(2)又与串行数据接收、命令解析及中断产生模块(5)相连; 所述通信参数配置模块(3)又与串行时钟产生及收发控制模块(6)相连; 所述数据发送FIFO模块(4)又与串行数据发送处理模块(7)相连; 所述串行数据接收、命令解析及中断产生模块(5),串行时钟产生及收发控制模块(6),串行数据发送处理模块(7)依次相连。
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