[发明专利]处理器系统及其多通道内存拷贝DMA加速器和方法有效
| 申请号： | 201110425530.7 | 申请日： | 2011-12-16 |
| 公开（公告）号： | CN102567256A | 公开（公告）日： | 2012-07-11 |
| 发明（设计）人： | 苏文;苏孟豪 | 申请（专利权）人： | 龙芯中科技术有限公司 |
| 主分类号： | G06F13/28 | 分类号： | G06F13/28 |
| 代理公司： | 北京远大卓悦知识产权代理事务所(普通合伙) 11369 | 代理人： | 史霞 |
| 地址： | 100190 北京*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供一种处理器系统及其多通道内存拷贝DMA加速器和方法。该处理器系统，包括通过数据总线连接在处理器核及内存之间的多通道直接内存访问DMA加速器，用于在处理器核发出内存拷贝命令产生数据读写请求时，根据所述数据读写请求的任务信息判断并分解所述数据读写请求的任务信息，并根据分解后的数据读写请求的任务信息，以及其中多个读写通道的读写频率和优先级，以及所述读写通道的标记位的值，控制多个读写通道并行向内存发出多次读写请求，完成数据读写。其具有高带宽、低延迟，高并行度，可重配置化，平台无关性的优点。 | ||
| 搜索关键词： | 处理器 系统 及其 通道 内存 拷贝 dma 加速器 方法 | ||
【主权项】：
一种处理器系统，包括处理器核，以及内存，其特征在于，还包括通过数据总线连接在处理器核及内存之间的多通道DMA加速器；所述多通道DMA加速器，用于在处理器核发出内存拷贝命令产生数据读写请求时，根据所述数据读写请求的任务信息判断并分解所述数据读写请求的任务信息，并根据分解后的数据读写请求的任务信息，以及其中多个读写通道的读写频率和优先级，以及所述读写通道的标记位的值，控制多个读写通道并行向内存发出多次读写请求，完成数据读写。
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